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5T9302PGGI

更新时间： 2024-02-28 08:47:50

品牌	Logo	应用领域
艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
15页	1602K
描述
Clock Driver, 5T Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 6.50 X 4.40 MM, 1 MM HEIGHT, GREEN, TSSOP-20

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5T9302PGGI 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	6.50 X 4.40 MM, 1 MM HEIGHT, GREEN, TSSOP-20
针数：	20	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.68
系列：	5T	输入调节：	DIFFERENTIAL MUX
JESD-30 代码：	R-PDSO-G20	JESD-609代码：	e3
长度：	6.5 mm	逻辑集成电路类型：	CLOCK DRIVER
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	20
实输出次数：	2	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP20,.25
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	2.5 V
传播延迟（tpd）：	1.35 ns	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.005 ns	座面最大高度：	1.2 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	2.7 V
最小供电电压 (Vsup)：	2.3 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	温度等级：	INDUSTRIAL
端子面层：	MATTE TIN	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	4.4 mm
最小 fmax：	450 MHz	Base Number Matches：	1

5T9302PGGI 数据手册

PRELIMINARY

2.5V LVDS, 1:2 CLOCK BUFFER

TERABUFFER™ II

IDT5T9302

General Description

Features

The IDT5T9302 2.5V differential clock buffer is a user-selectable

differential input to two LVDS outputs. The fanout from a

differential input to two LVDS outputs reduces loading on the

preceding driver and provides an efficient clock distribution

network. The IDT5T9302 can act as a translator from a differential

HSTL, eHSTL, LVEPECL (2.5V), LVPECL (3.3V), CML, or LVDS

input to LVDS outputs. A single-ended 3.3V / 2.5V LVTTL input

can also be used to translate to LVDS outputs. The redundant

input capability allows for an asynchronous change-over from a

primary clock source to a secondary clock source. Selectable

reference inputs are controlled by SEL.

• Guaranteed low skew: 5ps (typical)

• Very low duty cycle distortion: 20ps (typical)

• High speed propagation delay: 1.35ns (typical)

• Up to 450MHz operation

• Selectable inputs

• Hot insertable and over-voltage tolerant inputs

• 3.3V/2.5V LVTTL, HSTL eHSTL, LVEPECL (2.5V), LVPECL

(3.3V), CML or LVDS input interface

• Selectable differential inputs to two LVDS outputs

• Power-down mode

The IDT5T9302 outputs can be asynchronously enabled/disabled.

When disabled, the outputs will drive to the value selected by the

GL pin. Multiple power and grounds reduce noise.

• 2.5V V_DD

• -40°C to 85°C ambient operating temperature

• Available in TSSOP package

Applications

• Clock distribution

Pin Assignment

GND

V_DD

18 GND

V_DD

16 Q2

15 Q2

V_DD

SEL

GND 10

20-Lead TSSOP

4.4mm x 6.5mm x 1.0mm package body

G Package

Top View

The Preliminary Information presented herein represents a product in pre-production. The noted characteristics are based on initial product characterization and/or qualification.

Integrated Device Technology, Incorporated (IDT) reserves the right to change any circuitry or specifications without notice.

IDT™ LVDS CLOCK BUFFER TERABUFFER™ II

IDT5T9302 REV. A APRIL 29, 2008

12 3 4 5 6 7...15

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型号	品牌	获取价格	描述	数据表
5T9302PGGI8	IDT	获取价格	Clock Driver, 5T Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 6.50 X 4.40 MM, 1
5T9302PGI	IDT	获取价格	Clock Driver, 5T Series, 2 True Output(s), 0 Inverted Output(s), PDSO20, 6.50 X 4.40 MM, 1
5T9304	IDT	获取价格	LVDS, 1:4 Clock Buffer Terabuffer
5T9304_15	IDT	获取价格	LVDS, 1:4 Clock Buffer Terabuffer
5T9304EJGI	IDT	获取价格	LVDS, 1:4 Clock Buffer Terabuffer
5T9304EJI	IDT	获取价格	Low Skew Clock Driver, 5T Series, 8 True Output(s), 0 Inverted Output(s), PDSO24, 4.40 X 7
5T9304I	IDT	获取价格	LVDS, 1:4 Clock Buffer Terabuffer
5T9304PG	IDT	获取价格	Low Skew Clock Driver, 5T Series, 8 True Output(s), 0 Inverted Output(s), PDSO24, 4.40 X 7
5T9304PGG	IDT	获取价格	LVDS, 1:4 Clock Buffer Terabuffer
5T9306	RENESAS	获取价格	2.5V LVDS,1:6 Clock Buffer Terabuffer? II

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