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5M240ZM100C4

更新时间： 2024-02-19 08:42:50

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阿尔特拉 - ALTERA		时钟 LTE 可编程逻辑
页数	文件大小	规格书
30页	447K
描述
Flash PLD, 7.9ns, 192-Cell, CMOS, PBGA100, 6 X 6 MM, 0.50 MM PITCH, MBGA-100

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5M240ZM100C4 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	TFBGA, BGA100,11X11,20	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.22	Is Samacsys：	N
其他特性：	YES	最大时钟频率：	184.1 MHz
系统内可编程：	YES	JESD-30 代码：	S-PBGA-B100
JESD-609代码：	e1	JTAG BST：	YES
长度：	6 mm	I/O 线路数量：	79
宏单元数：	192	端子数量：	100
最高工作温度：	85 °C	最低工作温度：
组织：	79 I/O	输出函数：	MACROCELL
封装主体材料：	PLASTIC/EPOXY	封装代码：	TFBGA
封装等效代码：	BGA100,11X11,20	封装形状：	SQUARE
封装形式：	GRID ARRAY, THIN PROFILE, FINE PITCH	峰值回流温度（摄氏度）：	260
电源：	1.8,1.2/3.3 V	可编程逻辑类型：	FLASH PLD
传播延迟：	7.9 ns	认证状态：	Not Qualified
座面最大高度：	1.2 mm	子类别：	Programmable Logic Devices
最大供电电压：	1.89 V	最小供电电压：	1.71 V
标称供电电压：	1.8 V	表面贴装：	YES
技术：	CMOS	温度等级：	OTHER
端子面层：	TIN SILVER COPPER	端子形式：	BALL
端子节距：	0.5 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	40	宽度：	6 mm
Base Number Matches：	1

5M240ZM100C4 数据手册

3–2

Chapter 3: DC and Switching Characteristics for MAX V Devices

Operating Conditions

Recommended Operating Conditions

Table 3–2 lists recommended operating conditions for the MAX V device family.

Table 3–2. Recommended Operating Conditions for MAX V Devices

Symbol

Parameter

Conditions

Minimum

Maximum

Unit

1.8-V supply voltage for internal logic and

in-system programming (ISP)

V_CCINT(1)

MAX V devices

1.71

1.89

Supply voltage for I/O buffers, 3.3-V

operation

—

3.00

2.375

1.71

3.60

2.625

1.89

Supply voltage for I/O buffers, 2.5-V

operation

Supply voltage for I/O buffers, 1.8-V

operation

V_CCIO(1)

Supply voltage for I/O buffers, 1.5-V

operation

1.425

1.14

1.575

1.26

Supply voltage for I/O buffers, 1.2-V

operation

V_I

Input voltage

(2), (3), (4)

—

–0.5

4.0

V_CCIO

V_O

Output voltage

Commercial range

Industrial range

Extended range (5)

°C

T_J

Operating junction temperature

–40

100

125

Notes to Table 3–2:

(1) MAX V device ISP and/or user flash memory (UFM) programming using JTAG or logic array is not guaranteed outside the recommended

operating conditions (for example, if brown-out occurs in the system during a potential write/program sequence to the UFM, Altera recommends

that you read back the UFM contents and verify it against the intended write data).

(2) The minimum DC input is –0.5 V. During transitions, the inputs may undershoot to –2.0 V for input currents less than 100 mA and periods

shorter than 20 ns.

(3) During transitions, the inputs may overshoot to the voltages shown below based on the input duty cycle. The DC case is equivalent to 100%

duty cycle. For more information about 5.0-V tolerance, refer to the Using MAX V Devices in Multi-Voltage Systems chapter.

V_IN

Max. Duty Cycle

4.0 V 100% (DC)

4.1 V 90%

4.2 V 50%

4.3 V 30%

4.4 V 17%

4.5 V 10%

(4) All pins, including the clock, I/O, and JTAG pins, may be driven before V_CCINTand V_CCIOare powered.

(5) For the extended temperature range of 100 to 125°C, MAX V UFM programming (erase/write) is only supported using the JTAG interface. UFM

programming using the logic array interface is not guaranteed in this range.

MAX V Device Handbook

May 2011 Altera Corporation

123 4 5 6 7...30

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型号	品牌	获取价格	描述	数据表
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