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5M2210ZF324C4N

更新时间: 2024-01-26 03:44:58
品牌 Logo 应用领域
阿尔特拉 - ALTERA 时钟LTE可编程逻辑
页数 文件大小 规格书
30页 452K
描述
Flash PLD, 9.1ns, 1700-Cell, CMOS, PBGA324, 19 X 19 MM, 1 MM PITCH, LEAD FREE, FBGA-324

5M2210ZF324C4N 技术参数

是否无铅: 不含铅是否Rohs认证: 符合
生命周期:Transferred零件包装代码:BGA
包装说明:LBGA, BGA324,18X18,40针数:324
Reach Compliance Code:compliantECCN代码:3A991
HTS代码:8542.39.00.01风险等级:5.25
其他特性:YES最大时钟频率:247.5 MHz
系统内可编程:YESJESD-30 代码:S-PBGA-B324
JESD-609代码:e1JTAG BST:YES
长度:19 mmI/O 线路数量:271
宏单元数:1700端子数量:324
最高工作温度:85 °C最低工作温度:
组织:271 I/O输出函数:MACROCELL
封装主体材料:PLASTIC/EPOXY封装代码:LBGA
封装等效代码:BGA324,18X18,40封装形状:SQUARE
封装形式:GRID ARRAY, LOW PROFILE峰值回流温度(摄氏度):260
电源:1.8,1.2/3.3 V可编程逻辑类型:FLASH PLD
传播延迟:9.1 ns认证状态:Not Qualified
座面最大高度:1.55 mm子类别:Programmable Logic Devices
最大供电电压:1.89 V最小供电电压:1.71 V
标称供电电压:1.8 V表面贴装:YES
技术:CMOS温度等级:OTHER
端子面层:TIN SILVER COPPER端子形式:BALL
端子节距:1 mm端子位置:BOTTOM
处于峰值回流温度下的最长时间:40宽度:19 mm
Base Number Matches:1

5M2210ZF324C4N 数据手册

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3–24  
Chapter 3: DC and Switching Characteristics for MAX V Devices  
Timing Model and Specifications  
Table 3–33. External Timing Input Delay tGLOB Adders for GCLK Pins for MAX V Devices (Part 2 of 2)  
5M40Z/ 5M80Z/ 5M160Z/  
5M1270Z/ 5M2210Z  
5M240Z/ 5M570Z  
I/O Standard  
Unit  
C4  
C5, I5  
C4  
C5, I5  
Min  
Max  
Min  
Max  
Min  
Max  
Min  
Max  
Without Schmitt  
Trigger  
0
0
0
0
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
3.3-V LVCMOS  
With Schmitt  
Trigger  
387  
242  
429  
378  
681  
1,055  
0
442  
242  
483  
368  
658  
400  
287  
550  
459  
1,111  
2,067  
7
493  
353  
677  
565  
Without Schmitt  
Trigger  
2.5-V LVTTL /  
LVCMOS  
With Schmitt  
Trigger  
1.8-V LVTTL / Without Schmitt  
LVCMOS  
Trigger  
Without Schmitt  
Trigger  
1.5-V LVCMOS  
1,368  
2,544  
9
Without Schmitt  
Trigger  
1.2-V LVCMOS  
3.3-V PCI  
1,010  
0
Without Schmitt  
Trigger  
Table 3–34. External Timing Output Delay and tOD Adders for Fast Slew Rate for MAX V Devices  
5M40Z/ 5M80Z/ 5M160Z/  
5M1270Z/ 5M2210Z  
C4 C5, I5  
5M240Z/ 5M570Z  
I/O Standard  
Unit  
C4  
C5, I5  
Min  
Max  
0
Min  
Max  
0
Min  
Max  
0
Min  
Max  
0
16 mA  
8 mA  
8 mA  
4 mA  
14 mA  
7 mA  
6 mA  
3 mA  
4 mA  
2 mA  
3 mA  
20 mA  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
3.3-V LVTTL  
39  
58  
84  
104  
0
0
0
0
3.3-V LVCMOS  
39  
58  
84  
104  
195  
309  
909  
122  
196  
624  
686  
1,188  
1,279  
1,911  
39  
129  
188  
624  
694  
158  
251  
738  
850  
1,376  
1,517  
2,206  
4
2.5-V LVTTL / LVCMOS  
1.8-V LVTTL / LVCMOS  
1.5-V LVCMOS  
1,046  
1,694  
1,867  
2,715  
5
1,184  
1,280  
1,883  
58  
1.2-V LVCMOS  
3.3-V PCI  
LVDS  
122  
122  
129  
158  
158  
195  
RSDS  
129  
195  
MAX V Device Handbook  
May 2011 Altera Corporation  

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