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5962-9317704VUA

更新时间： 2024-02-26 09:59:19

品牌	Logo	应用领域
TEMIC		先进先出芯片
页数	文件大小	规格书
19页	357K
描述
FIFO, 16KX9, 15ns, Asynchronous, CMOS, CDIP28, 0.300 INCH, SIDE BRAZED, CERAMIC, DIP-28

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技术参数
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5962-9317704VUA 技术参数

生命周期：	Obsolete	包装说明：	DIP,
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.32.00.71	风险等级：	5.7
最长访问时间：	15 ns	周期时间：	25 ns
JESD-30 代码：	R-CDIP-T28	JESD-609代码：	e4
内存密度：	147456 bit	内存宽度：	9
功能数量：	1	端子数量：	28
字数：	16384 words	字数代码：	16000
工作模式：	ASYNCHRONOUS	最高工作温度：	125 °C
最低工作温度：	-55 °C	组织：	16KX9
可输出：	NO	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	DIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	并行/串行：	PARALLEL
认证状态：	Not Qualified	筛选级别：	MIL-PRF-38535 Class V
座面最大高度：	5.84 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	MILITARY	端子面层：	GOLD
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	宽度：	7.62 mm
Base Number Matches：	1

5962-9317704VUA 数据手册

Pin Names

NAMES

DESCRIPTION

I0-8

Q0-8

Inputs

Outputs

Write Enable

Read Enable

Reset

Empty Flag

Full Flag

XO/HF

Expansion Out/Half-Full Flag

Expansion IN

FL/RT

VCC

GND

First Load/Retransmit

Power Supply

Ground

Signal Description

Data In (I₀- I₈)

Data inputs for 9 - bit data

Reset (RS)

Reset occurs whenever the Reset (RS) input is taken to a low state. Reset returns both

internal read and write pointers to the first location. A reset is required after power-up

before a write operation can be enabled. Both the Read Enable (R) and Write Enable

(W) inputs must be in the high state during the period shown in Figure 1. (i.e. t_RSSbefore

the rising edge of RS) and should not change until t_RSRafter the rising edge of RS. The

Half-Full Flag (HF) will be reset to high After Reset (RS)

Figure 1. Reset

Notes: 1. EF, FF and HF may change status during reset, but flags will be valid at t_RSC

2. W and R = VIH around the rising edge of RS.

M67206F

Rev. E–20-Aug-01

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