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X1243S8I

更新时间： 2024-01-19 13:43:15
品牌 Logo 应用领域
英特矽尔 - INTERSIL 外围集成电路光电二极管闹钟可编程只读存储器电动程控只读存储器电可擦编程只读存储器时钟
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17页 293K
描述
Real Time Clock/Calendar/Alarm with EEPROM

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X1243S8I 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：PLASTIC, SOIC-8针数：8
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.81
最大时钟频率：0.032 MHz信息访问方法：I2C
中断能力：YJESD-30 代码：R-PDSO-G8
JESD-609代码：e0长度：4.9 mm
湿度敏感等级：1端子数量：8
计时器数量：1最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP8,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3/5 V
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：Timer or RTC最大供电电压：5.5 V
最小供电电压：2.7 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL最短时间：SECONDS
处于峰值回流温度下的最长时间：NOT SPECIFIED易失性：YES
宽度：3.9 mmuPs/uCs/外围集成电路类型：TIMER, REAL TIME CLOCK
Base Number Matches：1

X1243S8I 数据手册

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X1243  
compare, the device outputs an acknowledge on the SDA  
line.  
Device Addressing  
Following a start condition, the master must output a Slave  
Address Byte. The rst four bits of the Slave Address Byte  
specify access to the EEPROM array or to the CCR. Slave  
bits ‘1010’ access the EEPROM array. Slave bits ‘1101’  
access the CCR.  
Following the Slave Byte is a two byte word address. The  
word address is either supplied by the master device or  
obtained from an internal counter. On power up the internal  
address counter is set to address 0h, so a current address  
read of the EEPROM array starts at address 0. When  
required, as part of a random read, the master device must  
supply the 2 Word Address Bytes.  
Bit 3 through Bit 1 of the slave byte specify the device select  
bits.These are set to ‘111’.  
The last bit of the Slave Address Byte denes the oper-ation  
to be performed. When this R/W bit is a one, then a read  
operation is selected. A zero selects a write operation. Refer  
to Figure 12.  
In a random read operation, the slave byte in the “dummy  
write” portion must match the slave byte in the “read”  
section. That is if the random read is from the array the slave  
byte must be ‘1010111x’ in both instances. Similarly, for a  
random read of the Clock/ Control Registers, the slave byte  
must be ‘1101111x’ in both places.  
After loading the entire Slave Address Byte from the SDA  
bus, the device compares the device identier and device  
select bits with ‘1010111’ or ‘1101111’. Upon a correct  
Signals from  
Slave  
S
t
o
p
the Master  
Address  
A
C
K
A
C
K
A
C
K
SDA Bus  
1
A
C
K
Signals from  
the Slave  
Data  
(2)  
Data  
(n-1)  
Data  
(1)  
Data  
(n)  
(n is any integer greater than 1)  
FIGURE 12. SEQUENTIAL READ SEQUENCE  
Device Identifier  
Slave Address Byte  
Byte 0  
Array  
CCR  
1
1
0
1
1
0
0
1
R/W  
A8  
1
1
1
0
High Order Word Address  
Byte 1  
0
0
0
0
A10  
A9  
Low Order Word Address  
Byte 2  
A7  
D7  
A6  
D6  
A5  
D5  
A4  
D4  
A3  
D3  
A2  
D2  
A1  
D1  
A0  
D0  
Data Byte  
Byte 3  
FIGURE 13. SLAVE ADDRESS, WORD ADDRESS, AND DATA BYTES (64-BYTE PAGES)  
FN8249.0  
11  
April 28, 2005  
1...891011121314...17

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型号 品牌 获取价格 描述 数据表
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