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X1243S8I

更新时间： 2024-02-25 14:02:25
品牌 Logo 应用领域
英特矽尔 - INTERSIL 外围集成电路光电二极管闹钟可编程只读存储器电动程控只读存储器电可擦编程只读存储器时钟
页数 文件大小 规格书
17页 293K
描述
Real Time Clock/Calendar/Alarm with EEPROM

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X1243S8I 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：PLASTIC, SOIC-8针数：8
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.81
最大时钟频率：0.032 MHz信息访问方法：I2C
中断能力：YJESD-30 代码：R-PDSO-G8
JESD-609代码：e0长度：4.9 mm
湿度敏感等级：1端子数量：8
计时器数量：1最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP8,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：3/5 V
认证状态：Not Qualified座面最大高度：1.75 mm
子类别：Timer or RTC最大供电电压：5.5 V
最小供电电压：2.7 V标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL最短时间：SECONDS
处于峰值回流温度下的最长时间：NOT SPECIFIED易失性：YES
宽度：3.9 mmuPs/uCs/外围集成电路类型：TIMER, REAL TIME CLOCK
Base Number Matches：1

X1243S8I 数据手册

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X1243  
Capacitance (TA = 25°C, f = 1.0 MHz, VCC = 5V)  
SYMBOL  
PARAMETER  
MAX  
UNIT  
pF  
TEST CONDITIONS  
VOUT = 0V  
(1)  
COUT  
CIN  
Output Capacitance (SDA, IRQ)  
Input Capacitance (SCL)  
8
6
(1)  
pF  
VIN = 0V  
NOTE: This parameter is periodically sampled and not 100% tested.  
AC Characteristics  
AC Test Conditions  
Equivalent AC Output Load Circuit for  
= 5V  
V
CC  
Standard Output Load for testing the device with  
CC = 5.0V  
Input pulse levels  
VCC x 0.1 to VCC x 0.9  
10ns  
V
Input rise and fall times  
Input and output timing levels  
Output load  
VCC x 0.5  
5.0V  
Standard output load  
For V = 0.4V  
OL  
1533  
and I = 3 mA  
OL  
SDA.  
IRQ  
100pF  
AC Specifications (T = -40°C to +85°C, V  
= +2.7V to +5.5V, unless otherwise specied.)  
CC  
A
400kHz OPTION  
MIN  
UNIT  
SYMBOL  
PARAMETER  
MAX  
fSCL  
SCL Clock Frequency  
0
400  
kHz  
ns  
µs  
µs  
µs  
µs  
µs  
µs  
ns  
µs  
µs  
ns  
ns  
ns  
pF  
(1)  
tIN  
Pulse width Suppression Time at inputs  
SCL LOW to SDA Data Out Valid  
Time the bus must be free before a new transmission can start  
Clock LOW Time  
50  
tAA  
tBUF  
tLOW  
tHIGH  
tSU:STA  
tHD:STA  
tSU:DAT  
tHD:DAT  
tSU:STO  
tDH  
0.1  
0.9  
1.3  
1.3  
Clock HIGH Time  
0.6  
Start Condition Setup Time  
Start Condition Hold Time  
Data In Setup Time  
0.6  
0.6  
100  
Data In Hold Time  
0
0.6  
Stop Condition Setup Time  
Data Output Hold Time  
50  
(1)  
tR  
SDA and SCL Rise Time  
20 + .1Cb(2)  
20 + .1Cb(2)  
300  
300  
400  
(1)  
tF  
SDA and SCL Fall Time  
Cb  
Capacitive load for each bus line  
NOTES:  
1. This parameter is periodically sampled and not 100% tested.  
2. (Cb = total capacitance of one bus line in pF.  
FN8249.0  
13  
April 28, 2005  
1...1011121314151617

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