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UCC2540PWP

更新时间： 2024-11-28 22:36:35
品牌 Logo 应用领域
德州仪器 - TI 功效控制器
页数 文件大小 规格书
37页 560K
描述
HIGH EFFICIENCY SECONDARY SIDE SYNCHRONOUS BUCK PWM CONTROLLER

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UCC2540PWP 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Not Recommended零件包装代码：TSSOP
包装说明：HTSSOP, TSSOP20,.25针数：20
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：1 week
风险等级：7.78其他特性：PEAK CURRENT MODE ALSO POSSIBLE
模拟集成电路 - 其他类型：SWITCHING CONTROLLER控制模式：VOLTAGE-MODE
控制技术：PULSE WIDTH MODULATION最大输入电压：35 V
最小输入电压：8.5 V标称输入电压：12 V
JESD-30 代码：R-PDSO-G20JESD-609代码：e4
长度：6.5 mm湿度敏感等级：2
功能数量：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
最大输出电流：3.5 A封装主体材料：PLASTIC/EPOXY
封装代码：HTSSOP封装等效代码：TSSOP20,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, HEAT SINK/SLUG, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Switching Regulator or Controllers
最大供电电流 (Isup)：30 mA标称供电电压 (Vsup)：12 V
表面贴装：YES切换器配置：PUSH-PULL
最大切换频率：1000 kHz技术：BICMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmBase Number Matches：1

UCC2540PWP 数据手册

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SLUS539A − JUNE 2004 − REVISED AUGUST 2004  
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FEATURES  
APPLICATIONS  
D
On-Chip Predictive Gate Drivet for  
High-Efficiency Synchronous Buck  
Operation  
D
Secondary-Side Post Regulation (SSPR) for  
Multiple Output Power Supplies  
D
Cascaded Buck Converters  
D
D
Dual 3-A TrueDrivet Outputs  
D
Post Processing Converters for Bus  
Converter and DC Transformer Architectures  
1-MHz High Frequency Operation with 70-ns  
Delay from SYNCIN to G1 Output  
DESCRIPTION  
D
Leading Edge Modulation  
The UCC2540 is a secondary-side synchronous  
D
Overcurrent Protection using a Parallel  
Average Current Mode Control Loop  
buck PWM controller for high current and low  
output voltage applications. It can be used either  
as the local secondary-side controller for isolated  
dc-to-dc converters using two-stage cascaded  
topologies or as a secondary-side post regulator  
(SSPR) for multiple output power supplies.  
D
3 Modes to Support 2.7-V to 35-V Bias  
Operation  
D
D
D
D
D
Reverse Current Protection for Output Stage  
User Programmable Shutdown  
1.0% Initial Tolerance Bandgap Reference  
High Bandwidth Error Amplifiers  
The UCC2540 runs with the synchronization  
signal from either the primary side or the high duty  
cycle quasi-dc output of bus converters or dc  
transformers. For higher efficiency, it also  
incorporates the Predictive Gate Drivet  
technology that virtually eliminates body diode  
conduction losses in synchronous rectifiers.  
Thermally Enhanced HTSSOP 20-Pin  
PowerPADt Package  
SIMPLIFIED APPLICATION DIAGRAM  
Main  
Output  
UCC25701  
Input  
C1  
OUT  
AUX  
Output  
RSNS  
FB  
QP  
V
FB  
UCC2540  
13 VDRV  
VEA−  
REF  
7
2
14 G2  
12 G2S  
16 VDD  
19 BST  
18 G1  
R1  
Main  
Output  
TR 10  
COMP  
9
3
G2C  
20 SWS  
17 SW  
15 PGND  
CEA−  
RSET  
8
1
5
R2  
11 SS SYNCIN RAMP  
4
UDG−04057  
Predictive Gate Drive, TrueDrive, and PowerPAD, are a trademarks of Texas Instruments Incorporated.  
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Copyright 2004, Texas Instruments Incorporated  
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1
www.ti.com  
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