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TSPC603RVGB/Q14L

更新时间： 2024-11-28 03:00:03

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爱特美尔 - ATMEL		微控制器和处理器外围集成电路微处理器 PC 时钟
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PowerPC 603e RISC Microprocessor Family PID7t-603e

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TSPC603RVGB/Q14L 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	包装说明：	HBGA, BGA255,16X16,50
Reach Compliance Code：	unknown	ECCN代码：	3A001.A.3
HTS代码：	8542.31.00.01	风险等级：	5.88
Is Samacsys：	N	地址总线宽度：	32
位大小：	32	边界扫描：	YES
最大时钟频率：	75 MHz	外部数据总线宽度：	64
格式：	FLOATING POINT	集成缓存：	YES
JESD-30 代码：	S-CBGA-B255	JESD-609代码：	e0
长度：	21 mm	低功率模式：	YES
端子数量：	255	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	HBGA	封装等效代码：	BGA255,16X16,50
封装形状：	SQUARE	封装形式：	GRID ARRAY, HEAT SINK/SLUG
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	2.5,3.3 V
认证状态：	Not Qualified	筛选级别：	MIL-PRF-38535 Class Q
座面最大高度：	3 mm	速度：	300 MHz
子类别：	Microprocessors	最大供电电压：	2.625 V
最小供电电压：	2.375 V	标称供电电压：	2.5 V
表面贴装：	YES	技术：	CMOS
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	BALL
端子节距：	1.27 mm	端子位置：	BOTTOM
处于峰值回流温度下的最长时间：	NOT SPECIFIED	宽度：	21 mm
uPs/uCs/外围集成电路类型：	MICROPROCESSOR, RISC	Base Number Matches：	1

TSPC603RVGB/Q14L 数据手册

Features

• Superscalar (3 Instructions per Clock Peak)

• Dual 16 KB Caches

• Selectable Bus Clock

• 32-bit Compatibility PowerPC Implementation

• On-chip Debug Support

• Nap, Doze and Sleep Power Saving Modes

• Device Offered in Cerquad, CBGA 255, HiTCE CBGA 255 and CI-CGA 255

PowerPC^®603e

RISC

Microprocessor

Family

Features Specific to CBGA 255, HiTCE CBGA 255 and CI-CGA 255

• 7.4 SPECint95, 6.1 SPECfp95 at 300 MHz (Estimated)

• P_DTypically = 3.5W (266 MHz), Full Operating Conditions

• Branch Folding

• 64-bit Data Bus (32-bit Data Bus Option)

• 4-Gbytes Direct Addressing Range

• Pipelined Single/Double Precision Float Unit

• IEEE 754 Compatible FPU

• IEEE P 1149-1 Test Mode (JTAG/C0P)

• f_INTMax = 300 MHz

PID7t-603e

• f_BUSMax = 75 MHz

• Compatible CMOS Input/TTL Output

TSPC603R

Features Specific to Cerquad

• 5.6 SPECint95, 4 SPECfp95 and 200 MHz (Estimated)

• P_DTypically = 2.5W (200 MHz), Full Operating Conditions

1. Description

The PID7t-603e implementation of the PowerPC 603e (renamed after the 603R) is a

low-power implementation of the Reduced Instruction Set Computer (RISC) micropro-

cessor PowerPC family. The 603R is pin-to-pin compatible with the PowerPC 603e

and 603P in a Cerquad package. The 603R implements 32-bit effective addresses,

integer data types of 8, 16 and 32 bits, and floating-point data types of 32 and 64 bits.

The 603R is a low-power 2.5/3.3V design and provides four software controllable

power-saving modes. This device is a superscalar processor capable of issuing and

retiring as many as three instructions per clock. Instructions can be executed in any

order for increased performance, but, the 603R makes completion appear sequential.

It integrates five execution units and is able to execute five instructions in parallel.

The 603R provides independent on-chip, 16-Kbyte, four-way set-associative, physi-

cally addressed caches for instructions and data, as well as on-chip instructions, and

data Memory Management Units (MMUs). The MMUs contain 64-entry, two-way

set-associative, data and instruction translation look aside buffers that provide support

for demand-paged virtual memory address translation and variable-sized block trans-

lation. The 603R has a selectable 32- or 64-bit data bus and a 32-bit address bus. The

interface protocol allows multiple masters to compete for system resources through a

central external arbiter. The device supports single-beat and burst data transfers for

memory accesses, and supports memory-mapped I/Os.

Rev. 5410B–HIREL–09/05

12 3 4 5 6 7...58

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TSPC603RVGB/T8LC	ETC	获取价格	MICROPROCESSOR\|32-BIT\|CMOS\|BGA\|255PIN\|CERAMIC

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