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TMS27PC210A-15FNL PDF预览

TMS27PC210A-15FNL

更新时间： 2024-11-28 14:17:55
品牌 Logo 应用领域
德州仪器 - TI OTP只读存储器内存集成电路
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29页 402K
描述
1 048 576-Bit Programmable Read-Only Memory 44-PLCC 0 to 70

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TMS27PC210A-15FNL 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：LCC
包装说明：QCCJ, LDCC44,.7SQ针数：44
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.32.00.71风险等级：5.92
最长访问时间：150 nsI/O 类型：COMMON
JESD-30 代码：S-PQCC-J44长度：16.5862 mm
内存密度：1048576 bit内存集成电路类型：OTP ROM
内存宽度：16功能数量：1
端子数量：44字数：65536 words
字数代码：64000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：64KX16输出特性：3-STATE
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC44,.7SQ封装形状：SQUARE
封装形式：CHIP CARRIER并行/串行：PARALLEL
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not Qualified座面最大高度：4.57 mm
最大待机电流：0.0001 A子类别：OTP ROMs
最大压摆率：0.05 mA最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：COMMERCIAL端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：16.5862 mm
Base Number Matches：1

TMS27PC210A-15FNL 数据手册

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SMLS310D− NOVEMBER 1990 − REVISED SEPTEMBER 1997  
J PACKAGE  
(TOP VIEW)  
D Organization . . . 65536 by 16 Bits  
D Single 5-V Power Supply  
V
V
CC  
PGM  
1
40  
39  
38  
37  
36  
35  
PP  
E
D Operationally Compatible With Existing  
2
Megabit EPROMs  
DQ15  
DQ14  
DQ13  
DQ12  
DQ11  
DQ10  
DQ9  
NC  
3
D 40-Pin Dual-In-Line Package and 44-Lead  
A15  
A14  
A13  
4
Plastic Leaded Chip Carrier  
5
6
D All Inputs/Outputs Fully TTL Compatible  
7
34 A12  
33 A11  
D 10% V  
Tolerance  
CC  
8
D Maximum Access/Minimum Cycle Time  
9
32  
31  
30  
29  
28  
27  
26  
25  
24  
23  
22  
21  
A10  
A9  
10  
11  
12  
13  
14  
15  
16  
17  
18  
19  
20  
DQ8  
’27C/PC210A-10 100 ns  
’27C/PC210A-12 120 ns  
’27C/PC210A-15 150 ns  
’27C/PC210A-20 200 ns  
’27C/PC210A-25 250 ns  
†
†
GND  
GND  
A8  
DQ7  
DQ6  
DQ5  
DQ4  
DQ3  
DQ2  
DQ1  
DQ0  
G
A7  
A6  
A5  
A4  
D 16-Bit Output For Use in  
A3  
Microprocessor-Based Systems  
A2  
D Very High-Speed SNAP! Pulse  
A1  
Programming  
A0  
D Power-Saving CMOS Technology  
FN PACKAGE  
(TOP VIEW)  
D 3-State Output Buffers  
D 400-mV Minimum DC Noise Immunity With  
Standard TTL Loads  
D Latchup Immunity of 250 mA on All Input  
6
5
4
3
2 1 44 43 42 41 40  
and Output Pins  
7
A13  
A12  
A11  
A10  
A9  
DQ12  
DQ11  
DQ10  
DQ9  
39  
38  
37  
36  
35  
34  
33  
32  
31  
30  
29  
D No Pullup Resistors Required  
8
9
D Low Power Dissipation  
10  
11  
12  
13  
14  
15  
16  
17  
− Active . . . 275 mW Worst Case  
− Standby . . . 0.55 mW Worst Case  
(CMOS-Input Levels)  
DQ8  
†
†
GND  
NC  
A8  
GND  
NC  
DQ7  
DQ6  
DQ5  
DQ4  
D Temperature Range Options  
A7  
A6  
PIN NOMENCLATURE  
A5  
A0−A15  
DQ0−DQ15  
E
Address Inputs  
Inputs (programming)/Outputs  
Chip Enable  
18 19 20 21 22 23 24 25 26 27 28  
G
Output Enable  
GND  
NC  
PGM  
Ground  
No Internal Connection  
Program  
V
CC  
V
PP  
5-V Power Supply  
13-V Power Supply  
‡
†
‡
Pins 11 and 30 (J package) and pins 12 and 34 (FN  
package) must be connected externally to ground.  
Only in program mode  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 1997, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
POST OFFICE BOX 1443 • HOUSTON, TEXAS 77251−1443  
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