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TC74VHCT74AFN(ELFM

更新时间： 2024-12-02 08:54:07
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东芝 - TOSHIBA 光电二极管逻辑集成电路触发器
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6页 211K
描述
TC74VHCT74AFN(ELFM

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TC74VHCT74AFN(ELFM 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：SOP, SOP14,.25Reach Compliance Code：unknown
风险等级：5.92JESD-30 代码：R-PDSO-G14
负载电容（CL）：50 pF逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：65000000 Hz最大I（ol）：0.008 A
功能数量：2端子数量：14
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP14,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TAPE AND REEL
电源：5 V认证状态：Not Qualified
子类别：FF/Latches标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
触发器类型：POSITIVE EDGE

TC74VHCT74AFN(ELFM 数据手册

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TC74VHCT74AFN  
TOSHIBA CMOS Digital Integrated Circuit Silicon Monolithic  
TC74VHCT74AFN  
Dual D-Type Flip-Flop with Preset and Clear  
Note: The JEDEC SOP (FN) is not available in  
Japan.  
The TC74VHCT74 is an advanced high speed CMOS D-TYPE  
FLIP –FLOP fabricated with silicon gate C2MOS technology. It  
achieves the high speed operation similar to equivalent Bipolar  
Schottky TTL while maintaining the CMOS low power  
dissipation.  
TC74VHCT74AFN  
The signal level applied to the D INPUT is transferred to Q  
OUTPUT during the positive going transition of the CK pulse.  
CLR and PR are independent of the CK and are  
accomplished by setting the appropriate input low.  
The input voltage are compatible with TTL output voltage.  
This device may be used as a level converter for interfacing 3.3  
V to 5 V system.  
Weight  
SOL14-P-150-1.27:  
0.12 g (typ.)  
Input protection and output circuit ensure that 0 to 5.5 V can  
be applied to the input and output (Note) pins without regard to  
the supply voltage. These structure prevents device destruction  
due to mismatched supply and input/output voltages such as  
battery back up, hot board insertion, etc.  
Note:  
V
CC  
= 0 V  
Features  
•
•
•
High speed: f  
= 160 MHz (typ.) at V  
= 5 V  
max  
CC  
Low power dissipation: I  
= 2 μA (max) at Ta = 25°C  
CC  
Compatible with TTL inputs: V = 0.8 V (max)  
IL  
V
IH  
= 2.0 V (min)  
•
•
•
Power down protection is provided on all inputs and outputs  
Balanced propagation delays: t ≈ t  
pLH  
pHL  
Pin and function compatible with the 74 series (74AC/HC/F/ALS/LS etc.) 74 type.  
1
2012-02-29  
123456

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 		IC AHCT/VHCT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO1
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 		IC AHCT/VHCT SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO1
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