TC74ACT299F(F)

更新时间： 2024-12-01 13:14:27

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东芝 - TOSHIBA		移位寄存器触发器逻辑集成电路光电二极管
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9页	445K
描述
IC,SHIFT REGISTER,ACT-CMOS,SOP,20PIN,PLASTIC

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TC74ACT299F(F) 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
包装说明：	SOP, SOP20,.3	Reach Compliance Code：	unknown
风险等级：	5.84	Is Samacsys：	N
计数方向：	BIDIRECTIONAL	JESD-30 代码：	R-PDSO-G20
最大频率@ Nom-Sup：	80000000 Hz	位数：	8
功能数量：	1	端子数量：	20
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	SOP
封装等效代码：	SOP20,.3	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	电源：	5 V
认证状态：	Not Qualified	子类别：	Shift Registers
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	Base Number Matches：	1

TC74ACT299F(F) 数据手册

TC74ACT299P/F

TOSHIBA CMOS Digital Integrated Circuit Silicon Monolithic

TC74ACT299P,TC74ACT299F

8-Bit PIPO Shift Register with Asynchronous Clear

TC74ACT299P

The TC74ACT299 is an advanced high speed CMOS 8-BIT

PIPO SHIFT REGISTER fabricated with silicon gate and

double-layer metal wiring C²MOS technology.

It achieves the high speed operation similar to equivalent

Bipolar Schottky TTL while maintaining the CMOS low power

dissipation.

This device may be used as a level converter for interfacing

TLL or NMOS to High Speed CMOS. The inputs are compatible

with TTL, NMOS and CMOS output voltage levels.

It has a four modes (HOLD, SHIFT LEFT, SHIFT RIGHT and

LOAD DATA) controlled by the two selection inputs (S0, S1).

When one or both enable ( G1 , G2 ) are high, the eight I/O

outputs are forced to the high-impedance state; however,

sequential operation or clearing of the register is not affected.

All inputs are equipped with protection circuits against static

discharge or transient excess voltage.

TC74ACT299F

Features (Note 1)(Note 2)

Weight

DIP20-P-300-2.54A

SOP20-P-300-1.27A

•

High speed: f

= 130 MHz (typ.) at V

= 5 V

max

: 1.30 g (typ.)

: 0.22 g (typ.)

Low power dissipation: I

= 8 μA (max) at Ta = 25°C

Compatible with TTL outputs: V = 0.8 V (max)

= 2.0 V (min)

•

Symmetrical output impedance: |I | = I

= 24 mA (min)

Capability of driving 50 Ω

transmission lines.

∼

−

pHL

•

Balanced propagation delays: t

pLH

Pin and function compatible with 74F299

Note 1: Do not apply a signal to any bus terminal when it is in the output mode. Damage may result.

Note 2: All floating (high impedance) bus terminals must have their input levels fixed by means of pull up or pull

down resistors.

Pin Assignment

2007-10-01

12 3 4 5 6 7...9

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