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SSM2602_08

更新时间： 2022-04-23 23:00:11
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亚德诺 - ADI 解码器编解码器
页数 文件大小 规格书
32页 486K
描述
Low Power Audio Codec

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SSM2602_08 数据手册

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SSM2602  
Table 7. System Clock Timing  
Limit  
Parameter  
tXTIY  
tMCLKDS  
tXTIH  
tXTIL  
tCOP  
tMIN  
72  
40:60  
32  
32  
20  
tMAX  
Unit  
Description  
ns  
MCLK/XTI system clock cycle time  
MCLK/XTI duty cycle  
MCLK/XTI system clock pulse width high  
MCLK/XTI system clock pulse width low  
CLKOUT propagation delay from MCLK/XTI falling edge  
CLKODIV2 propagation delay from MCLK/XTI falling edge  
60:40:00  
ns  
ns  
ns  
ns  
tCOPDIV2  
20  
tXTIH  
tCOP  
MCLK/XTI  
tXTIL  
tXTIY  
CLKOUT  
CLKODIV2  
t
COPDIV2  
Figure 6. System (MCLK) Clock Timing  
Rev. 0 | Page 7 of 32  
1...45678910...32

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