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SN74HCT377DWRG4

更新时间： 2024-11-20 05:17:23
品牌 Logo 应用领域
德州仪器 - TI 触发器时钟
页数 文件大小 规格书
11页 447K
描述
OCTAL D-TYPE FLIP-FLOPS WITH CLOCK ENABLE

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SN74HCT377DWRG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：SOIC
包装说明：SOP, SOP20,.4针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.19其他特性：WITH HOLD MODE
系列：HCTJESD-30 代码：R-PDSO-G20
JESD-609代码：e4长度：12.8 mm
负载电容（CL）：50 pF逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：20000000 Hz最大I（ol）：0.004 A
湿度敏感等级：1位数：8
功能数量：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：5 V传播延迟（tpd）：38 ns
认证状态：Not Qualified座面最大高度：2.65 mm
子类别：FF/Latches最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：7.5 mm
最小 fmax：22 MHzBase Number Matches：1

SN74HCT377DWRG4 数据手册

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SN54HCT377, SN74HCT377  
OCTAL D-TYPE FLIP-FLOPS  
WITH CLOCK ENABLE  
SCLS067D – NOVEMBER 1988 – REVISED MARCH 2003  
Operating Voltage Range of 4.5 V to 5.5 V  
Outputs Can Drive Up To 10 LSTTL Loads  
Contain Eight Flip-Flops With Single-Rail  
Outputs  
Clock Enable Latched to Avoid False  
Clocking  
Low Power Consumption, 80-µA Max I  
CC  
Typical t = 12 ns  
pd  
±4-mA Output Drive at 5 V  
Applications Include:  
– Buffer/Storage Registers  
– Shift Registers  
Low Input Current of 1 µA Max  
Inputs Are TTL-Voltage Compatible  
– Pattern Generators  
SN54HCT377 . . . FK PACKAGE  
(TOP VIEW)  
SN54HCT377 . . . J OR W PACKAGE  
SN74HCT377 . . . DW OR N PACKAGE  
(TOP VIEW)  
CLKEN  
1Q  
V
CC  
1
2
3
4
5
6
7
8
9
20  
19 8Q  
18 8D  
17 7D  
16 7Q  
15 6Q  
14 6D  
13 5D  
12 5Q  
11 CLK  
3
2
1
20 19  
18  
1D  
8D  
7D  
7Q  
2D  
2Q  
3Q  
3D  
4D  
4
5
6
7
8
2D  
17  
16  
2Q  
3Q  
15 6Q  
14  
9 10 11 12 13  
3D  
6D  
4D  
4Q  
GND 10  
description/ordering information  
These devices are positive-edge-triggered D-type flip-flops. The ’HCT377 devices are similar to the ’HCT273  
devices, but feature a latched clock-enable (CLKEN) input instead of a common clear.  
Information at the data (D) inputs meeting the setup time requirements is transferred to the Q outputs on the  
positive-going edge of the clock (CLK) pulse if CLKEN is low. Clock triggering occurs at a particular voltage level  
and is not directly related to the transition time of the positive-going pulse. When CLK is at either the high or  
low level, the D input has no effect at the output. These devices are designed to prevent false clocking by  
transitions at CLKEN.  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP – N  
Tube  
SN74HCT377N  
SN74HCT377N  
–40°C to 85°C  
–55°C to 125°C  
Tube  
SN74HCT377DW  
SN74HCT377DWR  
SNJ54HCT377J  
SNJ54HCT377W  
SNJ54HCT377FK  
SOIC – DW  
HCT377  
Tape and reel  
Tube  
CDIP – J  
CFP – W  
LCCC – FK  
SNJ54HCT377J  
SNJ54HCT377W  
SNJ54HCT377FK  
Tube  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are  
available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
Copyright 2003, Texas Instruments Incorporated  
UNLESS OTHERWISE NOTED this document contains PRODUCTION  
DATA information current as of publication date. Products conform to  
specifications per the terms of Texas Instruments standard warranty.  
Production processing does not necessarily include testing of all  
parameters.  
1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567...11

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与SN74HCT377DWRG4相关器件

型号 品牌 获取价格 描述 数据表
SN74HCT377N TI

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