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SN74HC595DRG3 PDF预览

SN74HC595DRG3

更新时间： 2024-02-16 08:09:16
品牌 Logo 应用领域
德州仪器 - TI 移位寄存器触发器逻辑集成电路光电二极管输出元件
页数 文件大小 规格书
25页 846K
描述
8-BIT SHIFT REGISTERS WITH 3-STATE OUTPUT REGISTERS

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SN74HC595DRG3 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active零件包装代码：SOIC
包装说明：SOIC-16针数：16
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：0.51
Is Samacsys：N计数方向：RIGHT
系列：HC/UHJESD-30 代码：R-PDSO-G16
JESD-609代码：e3长度：9.9 mm
负载电容（CL）：150 pF逻辑集成电路类型：SERIAL IN PARALLEL OUT
最大频率@ Nom-Sup：25000000 Hz最大I（ol）：0.0078 A
湿度敏感等级：1位数：8
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TR
峰值回流温度（摄氏度）：260电源：2/6 V
最大电源电流（ICC）：0.08 mAProp。Delay @ Nom-Sup：34 ns
传播延迟（tpd）：250 ns认证状态：Not Qualified
施密特触发器：No座面最大高度：1.75 mm
子类别：Shift Registers最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：POSITIVE EDGE宽度：3.9 mm
最小 fmax：29 MHzBase Number Matches：1

SN74HC595DRG3 数据手册

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SN54HC595  
SN74HC595  
www.ti.com  
SCLS041H –DECEMBER 1982–REVISED NOVEMBER 2009  
8-BIT SHIFT REGISTERS WITH 3-STATE OUTPUT REGISTERS  
Check for Samples: SN54HC595 SN74HC595  
1
FEATURES  
SN54HC595...J OR W PACKAGE  
SN74HC595...D, DB, DW, N, NS, OR PW PACKAGE  
(TOP VIEW)  
•
•
•
8-Bit Serial-In, Parallel-Out Shift  
Wide Operating Voltage Range of 2 V to 6 V  
High-Current 3-State Outputs Can Drive Up To  
15 LSTTL Loads  
Q
Q
V
CC  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
B
Q
C
D
A
•
•
•
•
•
Low Power Consumption: 80-μA (Max) ICC  
tpd = 13 ns (Typ)  
Q
SER  
OE  
Q
E
Q
Q
12 RCLK  
F
±6-mA Output Drive at 5 V  
11  
10  
9
SRCLK  
SRCLR  
G
Low Input Current: 1 μA (Max)  
Shift Register Has Direct Clear  
Q
H
GND  
Q ′  
H
DESCRIPTION  
SN54HC595...FK PACKAGE  
(TOP VIEW)  
The 'HC595 devices contain an 8-bit serial-in,  
parallel-out shift register that feeds an 8-bit D-type  
storage register. The storage register has parallel  
3-state outputs. Separate clocks are provided for both  
the shift and storage register. The shift register has a  
direct overriding clear (SRCLR) input, serial (SER)  
input, and serial outputs for cascading. When the  
output-enable (OE) input is high, the outputs are in  
the high-impedance state.  
3
2
1
2 0 1 9  
18  
SER  
OE  
Q
4
5
6
7
8
D
Q
17  
16  
E
NC  
NC  
15 RCLK  
Q
F
14  
9 10 11 12 1 3  
Both the shift register clock (SRCLK) and storage  
register clock (RCLK) are positive-edge triggered. If  
both clocks are connected together, the shift register  
always is one clock pulse ahead of the storage  
register.  
SRCLK  
Q
G
NC – No internal connection  
1
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of Texas  
Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
PRODUCTION DATA information is current as of publication date.  
Copyright © 1982–2009, Texas Instruments Incorporated  
Products conform to specifications per the terms of the Texas  
Instruments standard warranty. Production processing does not  
necessarily include testing of all parameters.  
1234567...25

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