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NC7SZ175P6

更新时间： 2024-01-29 14:20:09
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其他 - ETC 触发器
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7页 81K
描述
Single D-Type Flip-Flop

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NC7SZ175P6 技术参数

是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：SOIC包装说明：TSSOP, TSSOP6,.08
针数：6Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.17
系列：LVC/LCX/ZJESD-30 代码：R-PDSO-G6
JESD-609代码：e3长度：2 mm
负载电容（CL）：50 pF逻辑集成电路类型：D FLIP-FLOP
最大频率@ Nom-Sup：150000000 Hz最大I（ol）：0.024 A
湿度敏感等级：1位数：1
功能数量：1端子数量：6
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP6,.08
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：6.2 ns
传播延迟（tpd）：16.5 ns认证状态：Not Qualified
座面最大高度：1.1 mm子类别：FF/Latches
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：1.65 V
标称供电电压 (Vsup)：1.8 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：POSITIVE EDGE
宽度：1.25 mm最小 fmax：175 MHz
Base Number Matches：1

NC7SZ175P6 数据手册

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May 1998  
Revised January 2001  
NC7SZ175  
TinyLogic UHS D-Type Flip-Flop  
with Asynchronous Clear  
General Description  
Features  
■ Space saving SC70 6-lead package  
The NC7SZ175 is a single positive edge-triggered D-type  
CMOS Flip-Flop with Asynchronous Clear from Fairchild’s  
Ultra High Speed Series of TinyLogic in the space saving  
SC70 6-lead package. The device is fabricated with  
advanced CMOS technology to achieve ultra high speed  
with high output drive while maintaining low static power  
dissipation over a very broad VCC operating range. The  
■ Ultra High Speed; tPD 2.6 ns Typ into 50 pF at 5V VCC  
■ High Output Drive; ±24 mA at 3V VCC  
■ Broad VCC Operating Range; 1.65V to 5.5V  
■ Matches the performance of LCX when operated at  
3.3V VCC  
device is specified to operate over the 1.65V to 5.5V VCC  
■ Power down high impedance inputs/output  
range. The inputs and output are high impedance when  
■ Overvoltage tolerant inputs facilitate 5V to 3V translation  
■ Patented noise/EMI reduction circuitry implemented  
VCC is 0V. Inputs tolerate voltages up to 7V independent of  
VCC operating voltage. This single flip-flop will store the  
state of the D input that meets the setup and hold time  
requirements on the LOW-to-HIGH Clock (CP) transition. A  
LOW input to Clear sets the Q output to LOW level. The  
Clear input is independent of clock.  
Ordering Code:  
Order  
Number  
Package  
Number  
MAA06A  
MAA06A  
Product Code  
Top Mark  
Z75  
Package Description  
Supplied As  
NC7SZ175P6  
NC7SZ175P6X  
6-Lead SC70, EIAJ SC88, 1.25mm Wide 250 Units on Tape and Reel  
6-Lead SC70, EIAJ SC88, 1.25mm Wide 3k Units on Tape and Reel  
Z75  
Function Table  
Logic Symbol  
Inputs  
Output  
IEEE/IEC  
CP  
D
C
Q
L
L
H
X
X
H
H
H
L
H
Connection Diagrams  
Qn  
L
X
H = HIGH Logic Level  
L = LOW Logic Level  
Qn = No change in data  
X = Immaterial  
Z = HIGH Impedance  
Pin Descriptions  
(Top View)  
Pin Names  
Description  
D
Data Input  
Clock Pulse Input  
Pin One Orientation Diagram  
CP  
C
Q
Clear Input  
Flip-Flop Output  
AAA represents Product Code Top Mark - see ordering code  
Note: Orientation of Top Mark determines Pin One location. Read the top  
product code mark left to right, Pin One is the lower left pin (see diagram).  
TinyLogic is a trademark of Fairchild Semiconductor Corporation.  
© 2001 Fairchild Semiconductor Corporation  
DS500158  
www.fairchildsemi.com  
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