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N8044AH-R0117

更新时间： 2024-01-10 13:53:47
品牌 Logo 应用领域
INNOVASIC 通信控制器微控制器
页数 文件大小 规格书
65页 597K
描述
SDLC Communications Controller

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N8044AH-R0117 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：QCCJ, LDCC44,.7SQReach Compliance Code：compliant
风险等级：5.92位大小：8
CPU系列：8051JESD-30 代码：S-PQCC-J44
JESD-609代码：e0端子数量：44
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：QCCJ
封装等效代码：LDCC44,.7SQ封装形状：SQUARE
封装形式：CHIP CARRIER电源：5 V
认证状态：Not QualifiedRAM（字节）：192
ROM（单词）：4096ROM可编程性：MROM
速度：12 MHz子类别：Microcontrollers
标称供电电压：5 V表面贴装：YES
技术：MOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：J BEND
端子节距：1.27 mm端子位置：QUAD
Base Number Matches：1

N8044AH-R0117 数据手册

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IA8044/IA8344  
Data Sheet  
SDLC Communications Controller  
March 30, 2010  
LIST OF FIGURES  
Figure 1. IA8044 and IA8344 40-Lead PDIP Package Diagram..................................................11  
Figure 2. PDIP Physical Package Dimensions .............................................................................13  
Figure 3. IA8044 and IA8344 44-Pin PLCC Package Diagram...................................................14  
Figure 4. PLCC Physical Package Dimensions ............................................................................16  
Figure 5. Functional Block Diagram ............................................................................................18  
Figure 6. Internal Data Memory Addresses 00h to FFh ...............................................................21  
Figure 7. Timer 0 Mode 0.............................................................................................................30  
Figure 8. Timer 0 Mode 1.............................................................................................................30  
Figure 9. Timer 0 Mode 2.............................................................................................................31  
Figure 10. Timer 0 Mode 3...........................................................................................................31  
Figure 11. Bit and Byte Processors...............................................................................................47  
Figure 12. Diagnostic Signal Routing...........................................................................................49  
Figure 13. Program Memory Read Cycle.....................................................................................52  
Figure 14. Data Memory Read Cycle ...........................................................................................53  
Figure 15. Data Memory Write Cycle ..........................................................................................54  
Figure 16. Synchronous Data Transmission.................................................................................55  
Figure 17. Synchronous Data Reception ......................................................................................55  
®
IA211010112-04  
UNCONTROLLED WHEN PRINTED OR COPIED  
http://www.Innovasic.com  
Customer Support:  
Page 6 of 65  
1-888-824-4184  
 
1...3456789...65

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