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MK2014ALF

更新时间： 2024-11-25 14:43:35

品牌	Logo	应用领域
艾迪悌 - IDT		时钟光电二极管外围集成电路晶体
页数	文件大小	规格书
4页	43K
描述
Clock Generator, 25MHz, CMOS, PDSO8, SOIC-8

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MK2014ALF 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	SOP,	针数：	8
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.83
其他特性：	IT ALSO OPERATES 3.3V SUPPLY	JESD-30 代码：	R-PDSO-G8
JESD-609代码：	e3	长度：	4.9 mm
湿度敏感等级：	1	端子数量：	8
最高工作温度：	70 °C	最低工作温度：
最大输出时钟频率：	25 MHz	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
主时钟/晶体标称频率：	14.31818 MHz	认证状态：	Not Qualified
座面最大高度：	1.778 mm	最大供电电压：	5.5 V
最小供电电压：	4.5 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Matte Tin (Sn)
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	3.9 mm	uPs/uCs/外围集成电路类型：	CLOCK GENERATOR, OTHER
Base Number Matches：	1

MK2014ALF 数据手册

MK2014A

Fast Ethernet Clock Source

_{ICR O}C_{LOC K}

Description

Features

• Packaged in 8 pin SOIC

The MK2014A is the ideal way to generate clocks

for Fast Ethernet cards or systems. It provides

20MHz and 25MHz clocks from an inexpensive

14.31818 MHz crystal or clock. In an 8 pin SOIC,

the MK2014A can save component count, board

space, and cost over surface mount crystals and

oscillators, and increase reliability by eliminating

mechanical devices from the board.

• Input crystal or clock frequency of 14.318 MHz

• Lowest jitter in the industry reliably clocks

sensitive Ethernet devices.

• Output clock frequencies of 20.00 MHz and

25.00 MHz

The MK2014A is a functionally identical update

of the MK2014 and should be used in all designs.

The only change is in crystal load capacitance as

stated on page 2.

• Zero ppm synthesis error in the output clocks

• Full CMOS outputs with 25mA drive capability

at TTL levels

MicroClock offers many other clocks for

computers and computer peripherals. Consult your

MicroClock representative when you need to

remove crystals and oscillators from your board.

• 3.3V or 5V±10% supply voltage

• Advanced, low power CMOS process

• Insensitive to input clock duty cycle

Block Diagram

VDD GND

Output

Buffer

20 MHz

25 MHz

Clock Synthesis

and Control

Circuitry

14.31818 MHz

crystal or clock

Output

Buffer

Crystal

Oscillator

Output

Buffer

14.318 MHz

MDS 2014A B

Revision 121598

Printed 11/15/00

MicroClock Division of ICS • 525 Race Street • San Jose • CA • 95126•(408)295-9800tel•(408)295-9818fax

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