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MC74VHC393MR2

更新时间： 2024-11-06 14:53:15
品牌 Logo 应用领域
安森美 - ONSEMI 光电二极管逻辑集成电路触发器
页数 文件大小 规格书
8页 172K
描述
AHC/VHC SERIES, ASYN NEGATIVE EDGE TRIGGERED 4-BIT UP BINARY COUNTER, PDSO14, EIAJ, PLASTIC, SOIC-14

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MC74VHC393MR2 技术参数

是否Rohs认证：不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：EIAJ, PLASTIC, SOIC-14
针数：14Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.16
Is Samacsys：N计数方向：UP
系列：AHC/VHCJESD-30 代码：R-PDSO-G14
JESD-609代码：e0长度：10.2 mm
负载/预设输入：YES逻辑集成电路类型：BINARY COUNTER
工作模式：ASYNCHRONOUS位数：4
功能数量：2端子数量：14
最高工作温度：125 °C最低工作温度：-55 °C
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：225传播延迟（tpd）：26.5 ns
认证状态：Not Qualified座面最大高度：2.05 mm
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：TIN LEAD端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED触发器类型：NEGATIVE EDGE
宽度：5.275 mm最小 fmax：105 MHz
Base Number Matches：1

MC74VHC393MR2 数据手册

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SEMICONDUCTOR TECHNICAL DATA  
The MC74VHC393 is an advanced high speed CMOS dual 4–bit binary  
ripple counter fabricated with silicon gate CMOS technology. It achieves high  
speed operation similar to equivalent Bipolar Schottky TTL while maintaining  
CMOS low power dissipation.  
This device consists of two independent 4–bit binary ripple counters with  
parallel outputs from each counter stage. A ÷256 counter can be obtained by  
cascading the two binary counters.  
D SUFFIX  
14–LEAD SOIC PACKAGE  
CASE 751A–03  
Internal flip–flops are triggered by high–to–low transitions of the clock  
input. Reset for the counters is asynchronous and active–high. State  
changes of the Q outputs do not occur simultaneously because of internal  
ripple delays. Therefore, decoded output signals are subject to decoding  
spikes and should not be used as clocks or as strobes except when gated  
with the Clock of the VHC393.  
DT SUFFIX  
14–LEAD TSSOP PACKAGE  
CASE 948G–01  
The inputs tolerate voltages up to 7V, allowing the interface of 5V systems  
to 3V systems.  
•
•
•
•
•
•
•
•
•
•
•
High Speed: f  
= 170MHz (Typ) at V  
= 5V  
max  
Low Power Dissipation: I  
CC  
= 4µA (Max) at T = 25°C  
CC  
A
High Noise Immunity: V  
Power Down Protection Provided on Inputs  
Balanced Propagation Delays  
Designed for 2V to 5.5V Operating Range  
= V  
= 28% V  
NIL CC  
NIH  
M SUFFIX  
14–LEAD SOIC EIAJ PACKAGE  
CASE 965–01  
Low Noise: V  
= 0.8V (Max)  
OLP  
ORDERING INFORMATION  
Pin and Function Compatible with Other Standard Logic Families  
Latchup Performance Exceeds 300mA  
ESD Performance: HBM > 2000V; Machine Model > 200V  
Chip Complexity: 236 FETs or 59 Equivalent Gates  
MC74VHCXXXD  
MC74VHCXXXDT  
MC74VHCXXXM  
SOIC  
TSSOP  
SOIC EIAJ  
PIN ASSIGNMENT  
LOGIC DIAGRAM  
CP1  
RD1  
1QA  
1QB  
1QC  
1QD  
1
2
3
4
14  
13  
12  
11  
V
CC  
CP2  
RD2  
2QA  
3, 11  
BINARY  
COUNTER  
nQA  
nQB  
nQC  
nQD  
4, 10  
5, 9  
1, 13  
2, 12  
CPn  
RDn  
6, 8  
5
6
10  
9
2QB  
2QC  
GND  
7
8
2QD  
FUNCTION TABLE  
Inputs  
Clock  
Reset  
Outputs  
X
H
L
↑
H
L
L
L
L
L
No Change  
No Change  
No Change  
Next State  
↓
6/97  
REV 0  
Motorola, Inc. 1997  
12345678

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