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Datasheet > 逻辑 > 触发器/锁存器> MC74F74DD
MC74F74DD PDF预览

MC74F74DD

更新时间： 2024-01-23 21:02:40
品牌 Logo 应用领域
摩托罗拉 - MOTOROLA 触发器锁存器逻辑集成电路光电二极管
页数 文件大小 规格书
3页 68K
描述
F/FAST SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14, PLASTIC, SOIC-14

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MC74F74DD 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
包装说明：DIP, DIP14,.3Reach Compliance Code：unknown
风险等级：5.92JESD-30 代码：R-PDIP-T14
JESD-609代码：e0逻辑集成电路类型：D FLIP-FLOP
功能数量：2端子数量：14
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE电源：5 V
认证状态：Not Qualified子类别：FF/Latches
标称供电电压 (Vsup)：5 V表面贴装：NO
技术：TTL温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
触发器类型：POSITIVE EDGEBase Number Matches：1

MC74F74DD 数据手册

 浏览型号MC74F74DD的Datasheet PDF文件第2页浏览型号MC74F74DD的Datasheet PDF文件第3页 
MC54/74F74  
DUAL D-TYPE POSITIVE  
EDGE-TRIGGERED FLIP-FLOP  
The MC54/74F74 is a dual D-type flip-flop with Direct Clear and Set inputs  
and complementary (Q, Q) outputs. Information at the input is transferred to  
the outputs on the positive edge of the clock pulse. Clock triggering occurs at  
avoltageleveloftheclockpulseandisnotdirectlyrelatedtothetransitiontime  
of the positive-going pulse. After the Clock Pulse input threshold voltage has  
been passed, the Data input is locked out and information present will not be  
transferred to the outputs until the next rising edge of the Clock Pulse input.  
DUAL D-TYPE POSITIVE  
EDGE-TRIGGERED FLIP-FLOP  
FAST SCHOTTKY TTL  
>
• ESD 4000 Volts  
J SUFFIX  
CERAMIC  
CONNECTION DIAGRAM  
CASE 632-08  
V
C
D
CP  
S
Q
Q
2
CC  
D2  
2
2
D2  
2
14  
1
14  
13  
12  
11  
10  
9
8
C
S
D2  
Q
CP  
D
CP  
D1  
Q
Q
1
1
2
1
2
2
N SUFFIX  
PLASTIC  
S
Q
D
C
1
D1  
2
D2  
CASE 646-06  
14  
1
1
2
3
4
5
6
7
C
D
CP  
S
Q
Q
1
GND  
D1  
1
1
D1  
1
D SUFFIX  
SOIC  
CASE 751A-02  
14  
1
FUNCTION TABLE (Each Half)  
Input  
Outputs  
@ t + 1  
ORDERING INFORMATION  
@ t  
n
n
MC54FXXJ  
MC74FXXN  
MC74FXXD  
Ceramic  
Plastic  
SOIC  
D
Q
L
Q
H
L
L
H
H
Asynchronous Inputs:  
LOGIC SYMBOL  
LOW Input to S sets Q to HIGH level  
D
LOW Input to C sets Q to LOW level  
D
Clear and Set are independent of clock  
4
10  
Simultaneous LOW on C and S makes both Q and Q HIGH  
D
D
S
1
S
D2  
D1  
H = HIGH Voltage Level  
L = LOW Voltage Level  
2
3
D
D
2
5
12  
11  
9
Q
Q
1
2
t
t
= Bit time before clock pulse  
+ 1 = Bit time after clock pulse  
CP  
CP  
2
n
n
1
Q
D1  
Q
1
2
6
8
C
C
D2  
1
13  
V
= PIN 14  
CC  
GND = PIN 7  
FAST AND LS TTL DATA  
4-33  
123

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与MC74F74DD相关器件

型号 品牌 获取价格 描述 数据表
MC74F74DDR2 MOTOROLA

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