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MAS31755AS

更新时间： 2024-11-14 14:43:23

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DYNEX		逻辑集成电路
页数	文件大小	规格书
13页	133K
描述
Error Detection And Correction Circuit, 31755 Series, 16-Bit, CMOS, CPGA68

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MAS31755AS 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
包装说明：	PGA, PGA68,10X10	Reach Compliance Code：	unknown
HTS代码：	8542.39.00.01	风险等级：	5.77
Is Samacsys：	N	其他特性：	FEED THROUGH EDAC
系列：	31755	JESD-30 代码：	S-CPGA-P68
JESD-609代码：	e0	负载电容（CL）：	50 pF
逻辑集成电路类型：	ERROR DETECTION AND CORRECTION CIRCUIT	位数：	16
功能数量：	1	端子数量：	68
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出特性：	3-STATE	封装主体材料：	CERAMIC, METAL-SEALED COFIRED
封装代码：	PGA	封装等效代码：	PGA68,10X10
封装形状：	SQUARE	封装形式：	GRID ARRAY
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	5 V
传播延迟（tpd）：	30 ns	认证状态：	Not Qualified
筛选级别：	38535V;38534K;883S	子类别：	Arithmetic Circuits
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	PIN/PEG
端子节距：	2.54 mm	端子位置：	PERPENDICULAR
处于峰值回流温度下的最长时间：	NOT SPECIFIED	Base Number Matches：	1

MAS31755AS 数据手册

MA^M3^A1³7¹⁷5⁵5⁵

16-Bit Feedthrough Error Detection

& Correction Unit (EDAC)

Replaces June 1999 version, DS3572-3.0

DS3572-4.0 January 2000

The MA31755 is a 16 bit Error Detection and Correction

Unit intended for use in high integrity systems for monitoring

and correcting data values retrieved from memory. The EDAC

is placed in the data bus between the processor and the

memory to be protected. Extra check bits added at each

memory location are programmed transparently by the EDAC

during a processor write cycle. The entire checkword and data

combination is verified on read cycles. If any one bit in the

incoming data stream is at fault the EDAC can correct the fault

transparently, presenting the corrected 16-bit value to the

processor. An error in two bits can be detected but cannot be

corrected. Both the correctable and uncorrectable error

conditions are signalled to the system to allow the processor to

take action as required. Parity is passed through the device

unchanged as data bus bit 16.

Tri-statable bus transceivers with a high drive capability

are incorporated at the MD and CB busses which allows the

usual bus driver devices to be removed and reduces the

overall timing overhead imposed on the data bus. Although

designed primarily for MA31750 application, this part may be

used in almost any 16-bit processor system requiring high data

integrity.

MD[0:16]

CB[0:5]

VDD

VSS

MA31755

EDAC

XERRN

ENCOR

ENFLG

PD[0:16]

CERRN

NCERRN

CS0

CS1N

CS2N

RDWN

FEATURES

Figure 1: Chip Signals

■ Fast Feedthrough (35ns Detect and Correct Cycle)

■ 16-Bit Operation with 6 Check Bits

■ Radiation Hard CMOS/SOS Technology

■ Feedthrough Operation

■ Error Corrected/Uncorrected Flags

■ High Drive Capability on Memory Busses

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