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M11L416256SA-28T

更新时间: 2024-01-30 23:08:13
品牌 Logo 应用领域
晶豪 - ESMT 动态存储器光电二极管内存集成电路
页数 文件大小 规格书
16页 230K
描述
EDO DRAM, 256KX16, 28ns, CMOS, PDSO40, TSOP2-44/40

M11L416256SA-28T 技术参数

生命周期:Obsolete包装说明:TSOP2, TSOP40/44,.46,32
Reach Compliance Code:unknown风险等级:5.84
访问模式:EDO PAGE最长访问时间:28 ns
其他特性:SELF REFRESHI/O 类型:COMMON
JESD-30 代码:R-PDSO-G40长度:18.41 mm
内存密度:4194304 bit内存集成电路类型:EDO DRAM
内存宽度:16功能数量:1
端口数量:1端子数量:40
字数:262144 words字数代码:256000
工作模式:ASYNCHRONOUS最高工作温度:70 °C
最低工作温度:组织:256KX16
输出特性:3-STATE封装主体材料:PLASTIC/EPOXY
封装代码:TSOP2封装等效代码:TSOP40/44,.46,32
封装形状:RECTANGULAR封装形式:SMALL OUTLINE, THIN PROFILE
电源:3.3 V认证状态:Not Qualified
刷新周期:512座面最大高度:1.2 mm
自我刷新:YES最大待机电流:0.002 A
子类别:DRAMs最大压摆率:0.19 mA
最大供电电压 (Vsup):3.6 V最小供电电压 (Vsup):3 V
标称供电电压 (Vsup):3.3 V表面贴装:YES
技术:CMOS温度等级:COMMERCIAL
端子形式:GULL WING端子节距:0.8 mm
端子位置:DUAL宽度:10.16 mm
Base Number Matches:1

M11L416256SA-28T 数据手册

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M11L416256A/M11L416256SA  
TRUTH TABLE  
ADDRESSES  
FUNCTION  
DQS  
NOTES  
RAS  
CASL CASH  
OE  
WE  
ROW  
X
COL  
X
Standby  
H
L
L
L
L
H
X
H
X
X
H
H
H
L
X
L
L
L
X
High-Z  
Read : Word  
L
L
L
H
L
ROW  
ROW  
ROW  
ROW  
COL  
COL  
COL  
COL  
Data-Out  
Read : Lower Byte  
Read : Upper Byte  
Write : Word (Early Write)  
Lower Byte, Data-Out  
Upper Byte, Data-Out  
H
L
L
Data-In  
Lower Byte, Data-In ,  
Upper Byte, High-Z  
Write : Lower Byte (Early)  
Write : Upper Byte (Early)  
L
L
L
H
L
L
X
X
ROW  
ROW  
COL  
COL  
Lower Byte, High-Z ,  
Upper Byte, Data-In  
H
L
L
L
Read-Write  
1st Cycle  
EDO-Page-Mode  
2nd Cycle  
Read  
L
L
L
L
L
L
L
L
H
H
L L  
H
ROW  
ROW  
COL  
COL  
COL  
Data-Out, Data-In  
Data-Out  
1, 2  
2
H
H
L
L
L
H
L
L
L
L
H
H
L
L
L
H
L
L
L
L
H
H
H
L
L
L
L
X
X
Data-Out  
2
Any Cycle  
Data-Out  
2
1st Cycle  
H
H
H
H
H
H
H
H
ROW  
ROW  
COL  
COL  
COL  
COL  
COL  
Data-In  
1
EDO-Page-Mode  
Write  
2nd Cycle  
L
Data-In  
1
1st Cycle  
H
H
L L  
L L  
H
H
Data-Out, Data-In  
Data-Out, Data-In  
Data-Out  
1, 2  
1, 2  
2
EDO-Page-Mode  
Read-Write  
2nd Cycle  
Hidden Refresh  
L
L
L
L
H
X
L
ROW  
ROW  
L
H
H
X
High-Z  
RAS -Only Refresh  
CBR Refresh  
H
H
L
L
L
L
L
L
H
H
X
X
X
X
X
X
High-Z  
High-Z  
3
3
Self-Refresh  
*Note : 1. These WRITE cycles may also be BYTE WRITE cycles (either CASL or CASH active).  
2. These READ cycles may also be BYTE READ cycles (either CASL or CASH active).  
3. Only one CAS must be active ( CASL or CASH ).  
Elite Memory Technology Inc  
Publication Date: Agu. 2001  
Revision : 1.3 7/16  

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