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LM1881

更新时间： 2024-01-21 01:25:34
品牌 Logo 应用领域
美国国家半导体 - NSC /
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12页 302K
描述
LM1881 Video Sync Separator

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LM1881 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：DIP
包装说明：DIP, DIP8,.3针数：8
Reach Compliance Code：compliant风险等级：5.66
商用集成电路类型：SYNC SEPARATOR ICJESD-30 代码：R-PDIP-T8
JESD-609代码：e3长度：9.817 mm
湿度敏感等级：1功能数量：1
端子数量：8最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP8,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：260电源：5/12 V
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：Other Consumer ICs最大压摆率：12 mA
最大供电电压 (Vsup)：12 V最小供电电压 (Vsup)：5 V
表面贴装：NO技术：BIPOLAR
温度等级：COMMERCIAL端子面层：Matte Tin (Sn)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：7.62 mmBase Number Matches：1

LM1881 数据手册

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Electrical Characteristics LM1881–X  
VCC = 5V; RSET = 680 kΩ; TA = –40˚C to +85˚C by correlation with 100% electrical testing at TA=25˚C  
Parameter  
Supply Current  
Conditions  
VCC = 5V  
Min  
Typ  
5.2  
5.5  
1.5  
70  
Max  
10  
Units  
Outputs at  
Logic 1  
Pin 2  
mA  
VCC = 12V  
12  
DC Input Voltage  
1.3  
55  
1.8  
85  
V
Input Threshold Voltage  
Input Discharge Current  
Input Clamp Charge Current  
RSET Pin Reference Voltage  
Composite Sync. & Vertical  
Outputs  
mV  
µA  
mA  
V
Pin 2; VIN = 2V  
Pin 2; VIN = 1V  
Pin 6;  
6
11  
16  
0.2  
1.10  
4.0  
11.0  
2.4  
10.0  
4.0  
11.0  
0.8  
1.22  
4.5  
1.35  
IOUT = 40 µA;  
Logic 1  
VCC = 5V  
VCC = 12V  
VCC = 5V  
VCC = 12V  
VCC = 5V  
VCC = 12V  
V
V
V
IOUT = 1.6 mA  
Logic 1  
3.6  
4.5  
Burst Gate & Odd/Even  
Outputs  
IOUT = 40 µA;  
Logic 1  
Composite Sync. Output  
Vertical Sync. Output  
Burst Gate Output  
Odd/Even Output  
Vertical Sync Width  
Burst Gate Width  
Vertical Default Time  
IOUT = −1.6 mA; Logic 0; Pin 1  
IOUT = −1.6 mA; Logic 0; Pin 3  
IOUT = −1.6 mA; Logic 0; Pin 5  
IOUT = −1.6 mA; Logic 0; Pin 7  
0.2  
0.2  
0.2  
0.2  
230  
4
0.8  
0.8  
0.8  
0.8  
588  
4.7  
90  
V
V
V
V
140  
2.2  
32  
µs  
µs  
µs  
2.7 kΩ from Pin 5 to VCC  
65  
Note 1: Absolute Maximum Ratings indicate limits beyond which damage to the device may occur. For guaranteed specifications and test conditions, see the  
Electrical Characteristics. The guaranteed specifications apply only for the test conditions listed.  
Note 2: For operation in ambient temperatures above 25˚C, the device must be derated based on a 150˚C maximum junction temperature and a package thermal  
resistance of 110˚C/W, junction to ambient.  
Note 3: ESD susceptibility test uses the “human body model, 100 pF discharged through a 1.5 kΩ resistor”.  
Note 4: Typicals are at T = 25˚C and represent the most likely parametric norm.  
J
Note 5: Relative difference between the input clamp voltage and the minimum input voltage which produces a horizontal output pulse.  
Note 6: Careful attention should be made to prevent parasitic capacitance coupling from any output pin (Pins 1, 3, 5 and 7) to the R  
Note 7: Delay time between the start of vertical sync (at input) and the vertical output pulse.  
pin (Pin 6).  
SET  
Typical Performance Characteristics  
RSET Value Selection  
vs Vertical Serration  
Pulse Separation  
Vertical Default  
Sync Delay Time  
vs RSET  
00915007  
00915008  
3
www.national.com  
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