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IDTQS3ST253Q8 PDF预览

IDTQS3ST253Q8

更新时间： 2024-11-29 14:51:31
品牌 Logo 应用领域
艾迪悌 - IDT 光电二极管逻辑集成电路
页数 文件大小 规格书
10页 74K
描述
Multiplexer And Demux/Decoder, 2-Func, 4 Line Input, 1 Line Output, True Output, CMOS, PDSO20, QSOP-20

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IDTQS3ST253Q8 技术参数

生命周期：Obsolete零件包装代码：QSOP
包装说明：SSOP,针数：20
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.84Is Samacsys：N
JESD-30 代码：R-PDSO-G20JESD-609代码：e0
长度：8.65 mm逻辑集成电路类型：MULTIPLEXER AND DEMUX/DECODER
功能数量：2输入次数：4
输出次数：1端子数量：20
最高工作温度：85 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SSOP
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, SHRINK PITCH
传播延迟（tpd）：0.25 ns认证状态：Not Qualified
座面最大高度：1.75 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：TIN LEAD
端子形式：GULL WING端子节距：0.635 mm
端子位置：DUAL宽度：3.9116 mm
Base Number Matches：1

IDTQS3ST253Q8 数据手册

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QUICKSWITCH® PRODUCTS  
HIGH-SPEED CMOS SYNCHRO-  
IDTQS3ST253  
SWITCH™ DUAL 4:1 MUX/DEMUX  
WITH ACTIVE TERMINATORS  
DESCRIPTION:  
FEATURES:  
TheQS3ST253isahigh-speedCMOS dual4:1 multiplexer/demultiplexer  
withactiveterminators(bus-holdcircuits)onthedemuxside. Portselection  
andconnection, controlledbySELsignals, canbeeitherasynchronousor  
synchronous. In the synchronous mode, the A, B, C, or D port to Y port  
connection is updated on the rising edge of the input clock CLK. Once the  
port-to-portconnectionismade,dataflowcanbebi-directionalwithatypical  
250ps propagation delay through the switch. Clock Enable, overriding  
Asynchronous Enable, and Asynchronous Select controls provide addi-  
tionaldesignflexibility.  
• Enhanced N channel FET with no inherent diode to Vcc  
• Bidirectional signal flow  
• Flow-through pinout  
• Zero propagation delay, zero ground bounce  
• 2 banks of 4:1 Mux/Demux  
• Port select synchronous to the clock  
• Undershoot clamp diodes on all switch and control inputs  
• Clock enable and Asynchronous enable  
• “Bus-hold” terminators on the Demux side  
• Asynchronous SEL option  
The bus-hold circuits latch the last data driven on the demux side,  
providinginfiniteholdtimeandglitch-freesignaltransitions. Synchronous  
controlsandbus-holdeasetimingconstraintsinmanyhighspeeddatamux/  
demux applications, such as bank interleaving.  
• Break-before-make feature  
• Bus-hold eliminates floating bus lines and reduces static power  
consumption  
The QS3ST253 can be used in 5V to 3.3V translation.  
• Available in QSOP package  
APPLICATIONS:  
• Video, audio, graphics switching, muxing  
FUNCTIONALBLOCKDIAGRAM  
=
T
OE0  
OE1  
SEL0  
CONTROL  
LOGIC  
SEL1  
CLKn  
CLKENn  
SYNCn  
A0  
B0  
C0  
D0  
A1  
B1  
C1  
D1  
T
T
T
T
T
T
T
T
Bank 0  
Bank 1  
Y0  
Y1  
TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.  
INDUSTRIAL TEMPERATURE RANGE  
NOVEMBER 1999  
1
c
1999 Integrated Device Technology, Inc.  
DSC-5533/1  
1234567...10

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