IDT79R3052-40J

更新时间： 2024-11-16 22:35:59

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RISControllers

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IDT79R3052-40J 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
Reach Compliance Code：	unknown	风险等级：	5.92
位大小：	32	JESD-30 代码：	S-PQCC-J84
JESD-609代码：	e0	湿度敏感等级：	1
端子数量：	84	最高工作温度：	70 °C
最低工作温度：		封装主体材料：	PLASTIC/EPOXY
封装代码：	QCCJ	封装等效代码：	LDCC84,1.2SQ
封装形状：	SQUARE	封装形式：	CHIP CARRIER
电源：	5 V	认证状态：	Not Qualified
速度：	40 MHz	子类别：	Microprocessors
最大压摆率：	600 mA	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn85Pb15)
端子形式：	J BEND	端子节距：	1.27 mm
端子位置：	QUAD	uPs/uCs/外围集成电路类型：	MICROPROCESSOR, RISC
Base Number Matches：	1

IDT79R3052-40J 数据手册

IDT79R3051 , 79R3051E

IDT79R3052 , 79R3052E

IDT79R3051/79R3052

RISControllers

Integrated Device Technology, Inc.

— On-chip DMA arbiter

FEATURES:

— Bus Interface minimizes design complexity

• Single clock input with 40%-60% duty cycle

• 35 MIPS, over 64,000 Dhrystones at 40MHz

• Low-cost 84-pin PLCC packaging that's pin-/package-

compatible with thermally enhanced 84-pin MQUAD.

• Flexible bus interface allows simple, low-cost designs

• 20, 25, 33, and 40MHz operation

• Complete software support

— Optimizing compilers

— Real-time operating systems

— Monitors/debuggers

• Instruction set compatible with IDT79R3000A and

IDT79R3001 MIPS RISC CPUs

• High level of integration minimizes system cost, power

consumption

— IDT79R3000A /IDT79R3001 RISC Integer CPU

— R3051 features 4KB of Instruction Cache

— R3052 features 8KB of Instruction Cache

— All devices feature 2kB of Data Cache

— “E” Versions (Extended Architecture) feature full

function Memory Management Unit, including 64-

entry Translation Lookaside Buffer (TLB)

— 4-deep write buffer eliminates memory write stalls

— 4-deep read buffer supports burst refill from slow

memory devices

— Floating Point Software

— Page Description Languages

BrCond(3:0)

Clk2xIn

Clock

Generator

Unit

Master Pipeline Control

System Control

Coprocessor

Integer

CPU Core

Exception/Control

Registers

General Registers

(32 x 32)

Memory Management

Registers

ALU

Shifter

Mult/Div Unit

Address Adder

PC Control

Int(5:0)

Translation

Lookaside Buffer

(64 entries)

Virtual Address

Physical Address Bus

Instruction

Cache

(8kB/4kB)

Data

Cache

(2kB)

Data Bus

Bus Interface Unit

4-deep

Write

Buffer

4-deep

DMA

BIU

Control

Read

Arbiter

Buffer

Address/

Data

DMA Rd/Wr SysClk

Ctrl Ctrl

2874 drw 01

Figure 1. R3051 Family Block Diagram

The IDT logo is a registered trademark, and RISChipset, RISController, R3041, R3051, R3052, R3071, R3081, R3720, R4400 and R4600 are trademarks of Integrated Device Technology, Inc.

COMMERCIAL TEMPERATURE RANGE

SEPTEMBER 1995

1995 Integrated Device Technology, Inc.

5.3

DSC-3000/5

12 3 4 5 6 7...23

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