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IDT7054L25PRF9

更新时间： 2024-10-28 14:51:23

品牌	Logo	应用领域
艾迪悌 - IDT		静态存储器内存集成电路
页数	文件大小	规格书
11页	99K
描述
Four-Port SRAM, 4KX8, 25ns, CMOS, PQFP128, PLASTIC, TQFP-128

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IDT7054L25PRF9 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	PLASTIC, TQFP-128	针数：	128
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.41	风险等级：	5.31
Is Samacsys：	N	最长访问时间：	25 ns
其他特性：	AUTOMATIC POWER DOWN; LOW POWER STANDBY MODE	JESD-30 代码：	R-PQFP-G128
JESD-609代码：	e0	长度：	20 mm
内存密度：	32768 bit	内存集成电路类型：	FOUR-PORT SRAM
内存宽度：	8	湿度敏感等级：	3
功能数量：	1	端口数量：	4
端子数量：	128	字数：	4096 words
字数代码：	4000	工作模式：	ASYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	4KX8	输出特性：	3-STATE
可输出：	YES	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装形状：	RECTANGULAR
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	并行/串行：	PARALLEL
峰值回流温度（摄氏度）：	240	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最小待机电流：	2 V
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	20	宽度：	14 mm
Base Number Matches：	1

IDT7054L25PRF9 数据手册

IDT7054S/L

HIGH-SPEED

4K x 8 FourPort^TM

STATIC RAM

◆

TTL-compatible; single 5V (±10%) power supply

Available in 128 pin Thin Quad Flatpack and 108 pin PGA

packages

Industrial temperature range (–40°C to +85°C) is available

for selected speeds

ꢀeatures

High-speed access

◆

– Commercial:20/25/35ns (max.)

– Industrial:25ns (max.)

◆

– Military:25/35ns(max.)

Low-power operation

◆

Description

– IDT7054S

Active:750mW(typ.)

Standby: 7.5mW (typ.)

– IDT7054L

Active:750mW(typ.)

Standby: 1.5mW (typ.)

True FourPort memory cells which allow simultaneous

TheIDT7054isahigh-speed4Kx8FourPort™StaticRAMdesigned

to be used in systems where multiple access into a common RAM is

required.ThisFourPortStaticRAMoffersincreasedsystemperformance

inmultiprocessorsystemsthathaveaneedtocommunicateinrealtimeand

alsooffersaddedbenefitforhigh-speedsystemsinwhichmultipleaccess

is requiredinthe same cycle.

◆

access of the same memory locations

Fully asynchronous operation from each of the four ports:

P1, P2, P3, and P4

TheIDT7054is alsodesignedtobeusedinsystems whereon-chip

hardware port arbitration is not needed. This part lends itself to those

systems whichcannottoleratewaitstates oraredesignedtobeableto

◆

ꢀunctionalBlockDiagram

R/WP1

CEP1

R/WP4

CEP4

OEP1

OEP4

COLUMN

I/O

COLUMN

I/O0P1-I/O7P1

I/O0P4-I/O7P4

I/O

PORT 1

PORT 4

ADDRESS

DECODE

LOGIC

ADDRESS

DECODE

LOGIC

A0P1 - A11P1

A0P2 - A11P2

A0P4 - A11P4

MEMORY

ARRAY

PORT 2

ADDRESS

DECODE

LOGIC

PORT 3

ADDRESS

DECODE

LOGIC

A0P3 - A11P3

COLUMN

I/O

COLUMN

I/O

I/O0P2-I/O7P2

I/O0P3-I/O7P3

OEP2

OEP3

CEP2

CEP3

R/WP3

R/WP2

3241 drw 01

NOVEMBER 2001

DSC 3241/11

12 3 4 5 6 7...11

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