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IDT23S09E-1HPG8

更新时间： 2024-11-21 14:51:23

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艾迪悌 - IDT		驱动光电二极管逻辑集成电路
页数	文件大小	规格书
8页	67K
描述
PLL Based Clock Driver, 23S Series, 9 True Output(s), 0 Inverted Output(s), PDSO16, TSSOP-16

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IDT23S09E-1HPG8 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP16,.25	针数：	16
Reach Compliance Code：	not_compliant	HTS代码：	8542.39.00.01
风险等级：	5.64	系列：	23S
输入调节：	STANDARD	JESD-30 代码：	R-PDSO-G16
JESD-609代码：	e0	长度：	5 mm
逻辑集成电路类型：	PLL BASED CLOCK DRIVER	最大I（ol）：	0.012 A
湿度敏感等级：	1	功能数量：	1
反相输出次数：		端子数量：	16
实输出次数：	9	最高工作温度：	70 °C
最低工作温度：		输出特性：	3-STATE
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	峰值回流温度（摄氏度）：	240
电源：	3.3 V	认证状态：	Not Qualified
Same Edge Skew-Max（tskwd）：	0.25 ns	座面最大高度：	1.2 mm
子类别：	Clock Drivers	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	3 V	标称供电电压 (Vsup)：	3.3 V
表面贴装：	YES	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	20	宽度：	4.4 mm
最小 fmax：	200 MHz	Base Number Matches：	1

IDT23S09E-1HPG8 数据手册

IDT23S09E

3.3VZERODELAYCLOCKBUFFER

COMMERCIALANDINDUSTRIALTEMPERATURERANGES

IDT23S09E

3.3V ZERO DELAY

CLOCK BUFFER, SPREAD

SPECTRUM COMPATIBLE

FEATURES:

DESCRIPTION:

• Phase-Lock Loop Clock Distribution

• 10MHz to 200MHz operating frequency

• Distributes one clock input to one bank of five and one bank of

four outputs

The IDT23S09E is a high-speed phase-lock loop (PLL) clock buffer,

designedtoaddresshigh-speedclockdistributionapplications. Thezero

delay is achieved by aligning the phase between the incoming clock and

the output clock, operable within the range of 10 to 200MHz.

• Separate output enable for each output bank

• Output Skew < 250ps

• Low jitter <200 ps cycle-to-cycle

• IDT23S09E-1 for Standard Drive

• IDT23S09E-1H for High Drive

TheIDT23S09Eisa16-pinversionoftheIDT23S05E. TheIDT23S09E

acceptsonereferenceinput,anddrivestwobanksoffourlowskewclocks.

The-1Hversionofthisdeviceoperatesupto200MHzfrequencyandhas

higher drive than the -1 device. All parts have on-chip PLLs which lock

to an input clock on the REF pin. The PLL feedback is on-chip and is

obtained from the CLKOUT pad. In the absence of an input clock, the

IDT23S09E enters power down. In this mode, the device will draw less

• No external RC network required

• Operates at 3.3V VDD

• Spread spectrum compatible

• Available in SOIC and TSSOP packages

than 12µA for Commercial Temperature range and less than 25µA for

Industrial temperature range, and the outputs are tri-stated.

The IDT23S09E is characterized for both Industrial and Commercial

operation.

NOTE: EOL for non-green parts to occur on 5/13/10 per

PDNU-09-01

FUNCTIONALBLOCKDIAGRAM

CLKOUT

CLKA1

PLL

REF

CLKA2

CLKA3

CLKA4

Control

Logic

CLKB1

CLKB2

CLKB3

CLKB4

TheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.

COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES

AUGUST 2009

2006 Integrated Device Technology, Inc.

DSC - 6399/11

12 3 4 5 6 7 8

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IDT23S09E-1HPG8 替代型号

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23S09E-1HPGG8	IDT	完全替代	3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE

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型号	品牌	获取价格	描述	数据表
IDT23S09E-1HPGG	IDT	获取价格	暂无描述
IDT23S09E-1HPGG8	IDT	获取价格	PLL Based Clock Driver, 23S Series, 9 True Output(s), 0 Inverted Output(s), PDSO16, GREEN,
IDT23S09E-1HPGGI	IDT	获取价格	PLL Based Clock Driver, 23S Series, 9 True Output(s), 0 Inverted Output(s), PDSO16, GREEN,
IDT23S09E-1HPGGI8	IDT	获取价格	PLL Based Clock Driver, 23S Series, 9 True Output(s), 0 Inverted Output(s), PDSO16, GREEN,
IDT23S09E-1HPGI	IDT	获取价格	3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE
IDT23S09E-1HPGI8	IDT	获取价格	PLL Based Clock Driver, 23S Series, 9 True Output(s), 0 Inverted Output(s), PDSO16, TSSOP-
IDT23S09E-1PG	IDT	获取价格	3.3V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE
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IDT23S09T	IDT	获取价格	2.5V ZERO DELAY CLOCK BUFFER, SPREAD SPECTRUM COMPATIBLE
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