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HMXCMP01DYF

更新时间： 2024-01-04 22:05:24

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霍尼韦尔 - HONEYWELL		放大器光电二极管
页数	文件大小	规格书
5页	392K
描述
Comparator, 1 Func, 24000uV Offset-Max, 125ns Response Time, CMOS, PDFP40, FLATPACK-40

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HMXCMP01DYF 技术参数

生命周期：	Active	包装说明：	HDFP,
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.76
放大器类型：	COMPARATOR	最大平均偏置电流 (IIB)：	0.001 µA
最大输入失调电压：	24000 µV	JESD-30 代码：	S-PDFP-F40
长度：	6.2484 mm	功能数量：	1
端子数量：	40	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	HDFP	封装形状：	SQUARE
封装形式：	FLATPACK, HEAT SINK/SLUG	标称响应时间：	125 ns
座面最大高度：	3.175 mm	子类别：	Comparator
供电电压上限：	5.25 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子形式：	FLAT
端子节距：	1.27 mm	端子位置：	DUAL
宽度：	6.2484 mm	Base Number Matches：	1

HMXCMP01DYF 数据手册

HMXCMP01

Radiation Hardened Comparator

Features

■

Rad Hard >300krad (Si)

■

Analog supply voltage:

4.75V to 5.25V

■

Digital supply voltage:

3.135V to 5.25V

■

Supply current: <2mA

Common mode voltage range:

0V to 5V

■

Input offset voltage: <24mV

Propagation delay: <125ns

Output rise/ fall times: <30ns

Power supply rejection ratio: >60dB

CMRR: >48dB

The HMXCMP01 is fabricated on a radiation hardened SOI-IV Silicon-On-Insulator (SOI)

CMOS process with very low power consumption operating on a single supply. It is

designed for low input current, low offset voltage and fast response time while

operating over the full military temperature range.

Input capacitance: <10pf

Input bias current: <1nA

Honeywell’s SOI-IV technology is radiation hardened through the use of advanced

and proprietary design, layout and process hardening techniques.

Functional

Diagram

Signal Deﬁnitions

Signal

VOUT

VDDD

N/C

Description

Output

Top View

VDDD

VOUT

VSS

VDD

Digital Power Supply 3.3V or 5V

No Connection

+ Input

VIN+

VIN-

–

- Input

N/C

No Connection

Analog Power Supply.

Ground

VIN+

VIN–

VDD

VSS

Block Diagram

VDD

VDDD

VIN+

VIN–

–

VOUT

The comparator has a low power two-

stage architecture. The ﬁrst stage is a

differential ampliﬁer with NMOS and

PMOS input differential pairs with

constant gm (transconductance).

This provides input rail-to-rail operation.

The second stage is made up of two

inverters that provide logic output at 3.3V

or 5V (depending on the value of VDDD).

Note that to avoid crow bar currents at

Logic high outputs, VDDD must be lower

or equal to VDD.

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