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DS2180AQ/T&R

更新时间： 2024-01-10 02:37:55
品牌 Logo 应用领域
美信 - MAXIM 电信电信集成电路
页数 文件大小 规格书
35页 495K
描述
Framer, CMOS, PQCC44, PLASTIC, LCC-44

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DS2180AQ/T&R 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：LCC
包装说明：QCCJ,针数：44
Reach Compliance Code：compliantHTS代码：8542.39.00.01
风险等级：5.23JESD-30 代码：S-PQCC-J44
JESD-609代码：e0长度：16.585 mm
湿度敏感等级：3功能数量：1
端子数量：44最高工作温度：70 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：QCCJ封装形状：SQUARE
封装形式：CHIP CARRIER峰值回流温度（摄氏度）：240
认证状态：Not Qualified座面最大高度：4.57 mm
标称供电电压：5 V表面贴装：YES
技术：CMOS电信集成电路类型：FRAMER
温度等级：COMMERCIAL端子面层：TIN LEAD
端子形式：J BEND端子节距：1.27 mm
端子位置：QUAD处于峰值回流温度下的最长时间：20
宽度：16.585 mmBase Number Matches：1

DS2180AQ/T&R 数据手册

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DS1386/DS1386P  
DESCRIPTION  
The DS2180A is a monolithic CMOS device designed to implement primary rate (1.544 MHz) T-carrier  
transmission systems. The 193S framing mode is intended to support existing Ft/Fs applications (12  
frames/superframe).  
The 193E framing mode supports the extended superframe format (24  
frames/superframe). Clear channel capability is provided by selection of appropriate zero suppression  
and signaling modes.  
Several functional blocks exist in the transceiver. The transmit framer/formatter generates appropriate  
framing bits, inserts robbed bit signaling, supervises zero suppression, generates alarms, and provides  
output clocks useful for data conditioning and decoding. The receive synchronizer establishes frame and  
multi-frame boundaries by identifying frame signaling bits, extracts signaling data, reports alarms and  
transmission errors, and provides output clocks useful for data conditioning and decoding.  
The control block is shared between transmit and receive sides. This block determines the frame, zero  
suppression, alarm and signaling formats. User access to the control block is by one of two modes.  
In the processor mode, pins 14 through 18 are a micro-processor/ microcontroller-compatible serial port  
which can be used for device configuration, control and status monitoring.  
In the hardware mode, no offboard processor is required. Pins 14 through 18 are reconfigured into “hard-  
wired” select pins. Features such as selection “clear” DS0 channels, insertion of idle code and alteration  
of sync algorithm are unavailable in the hardware mode.  
DS2180A BLOCK DIAGRAM Figure 1  
2 of 35  
1234567...35

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DS2180AQN ETC PCM Transceiver

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