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DS1707U

更新时间： 2024-11-29 13:02:43
品牌 Logo 应用领域
达拉斯 - DALLAS /
页数 文件大小 规格书
9页 69K
描述
Power Supply Support Circuit, Fixed, 1 Channel, PDSO8, 0.118 INCH, SOP-8

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DS1707U 技术参数

生命周期：Transferred包装说明：0.118 INCH, SOP-8
Reach Compliance Code：unknown风险等级：5.68
其他特性：Pushbutton Reset option可调阈值：NO
模拟集成电路 - 其他类型：POWER SUPPLY SUPPORT CIRCUITJESD-30 代码：R-PDSO-G8
信道数量：1功能数量：1
端子数量：8最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE认证状态：Not Qualified
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：1 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
温度等级：INDUSTRIAL端子形式：GULL WING
端子位置：DUALBase Number Matches：1

DS1707U 数据手册

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DS1707/DS1708  
DS1707/DS1708  
3.3 and 5.0 Volt MicroMonitor  
FEATURES  
PIN ASSIGNMENT  
• Holds microprocessor in check during power tran-  
PBRST  
1
2
3
4
8
7
6
5
RST  
RST  
NC  
sients  
V
CC  
• Automatically restarts microprocessor after power  
failure  
GND  
IN  
NMI  
• Monitors pushbutton for external override  
8–PIN DIP  
(300 MIL)  
• Accurate 5%, 10% or 20% resets for 3.3 systems and  
PBRST  
1
2
3
4
8
7
6
5
RST  
RST  
NC  
5% or 10% resets for 5.0 volt systems  
V
CC  
• Eliminates the need for discrete components  
• 20% tolerance compatible with 3.0 volt systems  
GND  
IN  
NMI  
8–PIN SOIC  
(150 MIL)  
• Pin compatible with the MAXIM MAX707/MAX708 in  
8–pin DIP and 8–pin SOIC packages  
PBRST  
1
2
3
4
8
7
6
5
RST  
• 8–pin DIP, 8–pin SOIC and 8–pin µ–SOP packages  
available  
V
RST  
NC  
CC  
GND  
IN  
NMI  
• Industrial temperature range –40°C to +85°C  
8–PIN µ–SOP  
(118 MIL)  
See Mech. Drawings  
Section  
DS1707 and DS1708_/R/S/T  
PIN DESCRIPTION  
PBRST  
–
–
–
–
–
–
–
–
Pushbutton Reset Input  
Power Supply  
Ground  
Input  
Non–maskable Interrupt  
No Connect  
Active Low Reset Output  
Active High Reset Output  
V
CC  
GND  
IN  
NMI  
NC  
RST  
RST  
DESCRIPTION  
TheDS1707/DS17083.3or5.0VoltMicroMonitormoni-  
tors three vital conditions for a microprocessor: power  
supply, voltage sense, and external override. A preci-  
sion temperature–compensated reference and  
condition a non–maskable interrupt is generated. As  
the voltage at the device degrades an internal power fail  
signal is generated which forces the reset to an active  
state. When V returns to an in–tolerance condition,  
CC  
comparator circuit monitors the status of V  
device and at an upstream point for maximum protec-  
tion. When the sense input detects an out–of–tolerance  
at the  
the reset signal is kept in the active state for a minimum  
of 130 ms to allow the power supply and processor to  
stabilize.  
CC  
ECopyright 1995 by Dallas Semiconductor Corporation.  
All Rights Reserved. For important information regarding  
patents and other intellectual property rights, please refer to  
Dallas Semiconductor data books.  
010996 1/9  
1234567...9

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