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DEI1160-SMS

更新时间： 2024-02-22 15:14:12

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DEIAZ		输入元件光电二极管接口集成电路
页数	文件大小	规格书
13页	517K
描述
PROGRAMMABLE GND/OPN & 28V/OPN DISCRETE INPUT INTERFACE IC

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技术参数
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DEI1160-SMS 技术参数

生命周期：	Obsolete	零件包装代码：	SOIC
包装说明：	HSOP,	针数：	16
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	8.31
其他特性：	IT ALSO OPERATES AT 5V AND 15V	接口集成电路类型：	INTERFACE CIRCUIT
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e0
长度：	9.9 mm	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	HSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, HEAT SINK/SLUG	认证状态：	Not Qualified
座面最大高度：	1.75 mm	最大供电电压：	3.6 V
最小供电电压：	3 V	标称供电电压：	3.3 V
表面贴装：	YES	温度等级：	MILITARY
端子面层：	TIN LEAD	端子形式：	GULL WING
端子节距：	1.27 mm	端子位置：	DUAL
宽度：	3.91 mm	Base Number Matches：	1

DEI1160-SMS 数据手册

Serial Interface

The DEI1160 incorporates a serial IO interface for programming the Discrete Input configuration and for reading the Discrete

Input status. Refer to Figure 2. The interface is SPI compatible and consists of /CS, SEL, SCLK, SDO, and SDI signals.

Waveform Figures 4 – 7 depict the Data Read sequence and Configuration Write sequence for both 8-Bit cycles and also 16

bit “daisy chain” applications.

Power Up Initialization

The DEI1160 incorporates an on-chip power-up reset circuit and power sequencing provisions to force the DIN inputs to the

28V/Open (internal pull down) state upon power. The reset circuit monitors the VCC logic supply and forces the

Configuration Register to the Logic 0 (28V/Open) while VCC is stabilizing. The AFE circuit is designed to present the

28V/Open (internal pull down) condition when VDD supply is present and VCC is below operational voltage.

SEL

/CS

SCLK

VALID

DIN[1:8]

SDI

SDO

DIN8

DIN7

DIN6

DIN5

DIN4

DIN3

DIN2

DIN1

DIN inputs latched into DATA S-Reg

Figure 4 Read Data Register

SEL

/CS

SCLK

VALID

DIN[1:8]

SI8

SI7

SI6

SI5

SI4

SI3

SI2

SI1

SDI

DIN8

DIN7

DIN6

DIN5

DIN4

DIN3

DIN2

DIN1

SI8

SI7

SI6

SI5

SI4

SI3

SI2

SI1

SDO

DIN inputs latched into DATA S-Reg

SDI data shifted to SDO after 8 bit delay

Figure 5 Read Data Register, 16 Bit Daisy Chain

5 of 13

DS-MW-01160-01 Rev D

03/17/2014

1 2 3 456 7 8...13

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