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DAC7614UBG4

更新时间： 2024-01-02 10:47:44
品牌 Logo 应用领域
德州仪器 - TI 光电二极管转换器数模转换器
页数 文件大小 规格书
17页 529K
描述
四路串行输入 12 位电压输出数模转换器 | DW | 16 | -40 to 85

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DAC7614UBG4 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP16,.4针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：6 weeks
风险等级：1.78最大模拟输出电压：2.5 V
最小模拟输出电压：-2.5 V转换器类型：D/A CONVERTER
输入位码：BINARY输入格式：SERIAL
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：10.3 mm最大线性误差 (EL)：0.0244%
湿度敏感等级：3标称负供电电压：-5 V
位数：12功能数量：1
端子数量：16最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP16,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
峰值回流温度（摄氏度）：260电源：5/+-5 V
认证状态：Not Qualified采样速率：0.089 MHz
座面最大高度：2.65 mm最大稳定时间：10 µs
标称安定时间 (tstl)：10 µs子类别：Other Converters
最大压摆率：1.9 mA标称供电电压：5 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.5 mm

DAC7614UBG4 数据手册

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Note that CS and CLK are combined with an OR gate and  
the output controls the serial-to-parallel shift register inter-  
nal to the DAC7614 (see the block diagram on the front of  
this data sheet). These two inputs are completely inter-  
changeable. In addition, care must be taken with the state of  
CLK when CS rises at the end of a serial transfer. If CLK is  
LOW when CS rises, the OR gate will provide a rising edge  
to the shift register, shifting the internal data one additional  
bit. The result will be incorrect data and possible selection of  
the wrong DAC.  
STATE OF  
SELECTED  
DAC  
SELECTED  
DAC  
REGISTER  
A1  
A0  
LOADDACS RESET  
REGISTER  
L(1)  
L
L
H
L
L
L
H
H
H
H
H
L
A
B
Transparent  
Transparent  
Transparent  
Transparent  
(All Latched)  
Reset(3)  
H
L
C
H
H
X
X
L
D
X(2)  
X
H
X
NONE  
ALL  
NOTES: (1) L = Logic LOW. (2) X = Don’t Care. (3) Resets to either 000H or  
800H, per the RESETSEL state (LOW = 000H, HIGH = 800H). When RESET  
rises, all registers that are in their latched state retain the reset value.  
If both CS and CLK are used, then CS should rise only when  
CLK is HIGH. If not, then either CS or CLK can be used to  
operate the shift register. See Table III for more information.  
TABLE II. Control Logic Truth Table.  
Digital Input Coding  
CS(1)  
CLK(1) LOADDACS  
RESET  
SERIAL SHIFT REGISTER  
The DAC7614 input data is in Straight Binary format. The  
output voltage is given by the following equation:  
H(2)  
L(4)  
L
X(3)  
L
H
H
H
H
No Change  
No Change  
(VREFH – VREFL) • N  
(5)  
↑
H
H
Advanced One Bit  
Advanced One Bit  
No Change  
VOUT = VREFL  
+
4096  
↑
L
X
X
H
H
H(6)  
H(6)  
L(7)  
H
H
where N is the digital input code (in decimal). This equation  
does not include the effects of offset (zero-scale) or gain  
(full-scale) errors.  
L(8)  
No Change  
NOTES: (1) CS and CLK are interchangeable. (2) H = Logic HIGH. (3) X =  
Don’t Care. (4) L = Logic LOW (5) = Positive Logic Transition. (6) A HIGH  
value is suggested in order to avoid a “false clock” from advancing the shift  
register and changing the shift register. (7) If data is clocked into the serial  
register while LOADDACS is LOW, the selected DAC register will change as  
the shift register bits “flow” through A1 and A0. This will corrupt the data in  
each DAC register that has been erroneously selected. (8) RESET LOW  
causes no change in the contents of the serial shift register.  
TABLE III. Serial Shift Register Truth Table.  
®
11  
DAC7614  
1...891011121314...17

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DAC7614UBG4 替代型号

型号 品牌 替代类型 描述 数据表
DAC7614UB/1K TI

完全替代

 		Quad, Serial Input, 12-Bit, Voltage Output
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完全替代

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型号 品牌 描述 获取价格 数据表
DAC7614UG4 TI 四路串行输入 12 位电压输出数模转换器 | DW | 16 | -40 to 85

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