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Datasheet > 转换器 > 数模转换器> DAC128S085CIMT
DAC128S085CIMT PDF预览

DAC128S085CIMT

更新时间： 2024-02-19 20:29:22
品牌 Logo 应用领域
美国国家半导体 - NSC 转换器数模转换器光电二极管
页数 文件大小 规格书
24页 524K
描述
12-Bit Micro Power OCTAL Digital-to-Analog Converter with Rail-to-Rail Outputs

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DAC128S085CIMT 技术参数

是否无铅：不含铅是否Rohs认证：符合
生命周期：Active零件包装代码：QFN
包装说明：WQFN-16针数：16
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：6 weeks
风险等级：1.14Is Samacsys：N
最大模拟输出电压：5.5 V最小模拟输出电压：
转换器类型：D/A CONVERTER输入位码：BINARY
输入格式：SERIALJESD-30 代码：S-PQCC-N16
JESD-609代码：e3长度：4 mm
最大线性误差 (EL)：0.1953%湿度敏感等级：1
位数：12功能数量：1
端子数量：16最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：HVQCCN封装等效代码：LCC16,.16SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3/5 V
认证状态：Not Qualified采样速率：2.5 MHz
座面最大高度：0.8 mm最大稳定时间：8.5 µs
标称安定时间 (tstl)：8.5 µs子类别：Other Converters
标称供电电压：3 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：Matte Tin (Sn)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：4 mm
Base Number Matches：1

DAC128S085CIMT 数据手册

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Limits  
(Note 8)  
Units  
(Limits)  
Symbol  
Parameter  
Conditions  
Typical  
1.95  
4.85  
1.68  
3.80  
0.6  
VA = 2.7V  
to 3.6V  
3.0  
7.0  
mW (max)  
mW (max)  
mW  
fSCLK = 30 MHz  
output unloaded  
VA = 4.5V  
to 5.5V  
Total Power Consumption (output  
unloaded)  
PN  
VA = 2.7V  
to 3.6V  
fSCLK = 0  
output unloaded  
VA = 4.5V  
to 5.5V  
mW  
VA = 2.7V  
to 3.6V  
5.4  
16.5  
3.6  
µW (max)  
µW (max)  
µW (max)  
µW (max)  
fSCLK = 30 MHz, SYNC =  
VA and DIN = 0V after PD  
mode loaded  
VA = 4.5V  
to 5.5V  
2.5  
Total Power Consumption in all PD  
PPD  
Modes,  
(Note 9)  
VA = 2.7V  
to 3.6V  
0.3  
fSCLK = 0, SYNC = VA and  
DIN = 0V after PD mode  
loaded  
VA = 4.5V  
to 5.5V  
1
11  
A.C. and Timing Characteristics  
The following specifications apply for VA = +2.7V to +5.5V, VREF1,2 = VA, CL = 200 pF to GND, fSCLK = 30 MHz, input code range  
48 to 4047. Boldface limits apply for TMIN ≤ TA ≤ TMAX and all other limits are at TA = 25°C, unless otherwise specified.  
Limits  
(Note 8)  
Units  
(Limits)  
Symbol  
Parameter  
SCLK Frequency  
Conductions  
Typical  
fSCLK  
40  
6
30  
MHz (max)  
400h to C00h code change  
Output Voltage Settling Time  
(Note 9)  
ts  
8.5  
µs (max)  
RL = 2kΩ, CL = 200 pF  
SR  
GI  
Output Slew Rate  
Glitch Impulse  
1
40  
0.5  
0.5  
1
V/µs  
nV-sec  
nV-sec  
nV-sec  
nV-sec  
kHz  
Code change from 800h to 7FFh  
DF  
DC  
Digital Feedthrough  
Digital Crosstalk  
CROSS DAC-to-DAC Crosstalk  
MBW Multiplying Bandwidth  
VREF1,2 = 2.5V ± 2Vpp  
360  
VREF1,2 = 2.5V ± 0.5Vpp  
100Hz < fIN < 20kHz  
THD+N Total Harmonic Distortion Plus Noise  
ONSD Output Noise Spectral Density  
−80  
dB  
DAC Code = 800h, 10kHz  
BW = 30kHz  
VA = 3V  
40  
14  
3
nV/sqrt(Hz)  
µV  
ON  
Output Noise  
µsec  
tWU  
Wake-Up Time  
VA = 5V  
20  
25  
7
µsec  
1/fSCLK  
tCH  
SCLK Cycle Time  
SCLK High time  
SCLK Low Time  
33  
ns (min)  
ns (min)  
ns (min)  
ns (min)  
ns (max)  
10  
10  
tCL  
7
3
10  
SYNC Set-up Time prior to SCLK  
Falling Edge  
tSS  
tDS  
tDH  
1 / fSCLK - 3  
Data Set-Up Time prior to SCLK  
Falling Edge  
1.0  
2.5  
2.5  
ns (min)  
ns (min)  
Data Hold Time after SCLK Falling  
Edge  
1.0  
0
3
1 / fSCLK - 3  
15  
ns (min)  
ns (max)  
ns (min)  
SYNC Hold Time after the 16th falling  
edge of SCLK  
tSH  
tSYNC  
SYNC High Time  
5
www.national.com  
6
1...3456789...24

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