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CY8CPLC20-48LFXI

更新时间： 2024-01-30 08:30:27

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赛普拉斯 - CYPRESS		通信
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Powerline Communication Solution

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CY8CPLC20-48LFXI 技术参数

是否Rohs认证：	符合	生命周期：	Active
零件包装代码：	QFN	包装说明：	HVQCCN, LCC48,.27SQ,20
针数：	48	Reach Compliance Code：	compliant
ECCN代码：	EAR99	HTS代码：	8542.31.00.01
风险等级：	5.08	JESD-30 代码：	S-XQCC-N48
JESD-609代码：	e4	长度：	7 mm
湿度敏感等级：	3	端子数量：	48
最高工作温度：	85 °C	最低工作温度：	-40 °C
封装主体材料：	UNSPECIFIED	封装代码：	HVQCCN
封装等效代码：	LCC48,.27SQ,20	封装形状：	SQUARE
封装形式：	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	峰值回流温度（摄氏度）：	260
电源：	5 V	认证状态：	Not Qualified
座面最大高度：	1 mm	子类别：	Other Microprocessor ICs
最大压摆率：	14 mA	最大供电电压：	5.25 V
最小供电电压：	4.75 V	标称供电电压：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	NO LEAD	端子节距：	0.5 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	7 mm	uPs/uCs/外围集成电路类型：	MICROPROCESSOR CIRCUIT
Base Number Matches：	1

CY8CPLC20-48LFXI 数据手册

浏览型号CY8CPLC20-48LFXI的Datasheet PDF文件第10页

CY8CPLC20

2.1.1 The Digital System

Figure 2-3. Digital System Block Diagram

Port 7

Port 5

Port 3

Por t 1

The digital system contains 16 digital PSoC blocks. Each block

is an 8-bit resource that can be used alone, or combined with

other blocks to form 8-, 16-, 24-, and 32-bit peripherals called

user module references. Digital peripheral configurations

include:

Port 6

Port 4

Port 2

Port 0

To SystemBus

DigitalClocks

FromCore

ToAnalog

System

■ PWMs (8 to 32 bit)

■ PWMs with Dead Band (8 to 32 bit)

■ Counters (8 to 32 bit)

DIGITAL SYSTEM

DigitalPSoCBlockArray

Row 0

■ Timers (8 to 32 bit)

■ UART 8 bit with selectable parity (up to four)

DBB00

DBB01

DCB02

DCB03

■ SPI master and slave (up to four each)

■ I²C slave and multi-master (one available as a System

Resource)

Row 1

■ Cyclical Redundancy Checker and Generator (8 to 32 bit)

■ IrDA (up to four)

DBB10

DBB11

DBB21

DCB12

DCB13

■ Pseudo Random Sequence Generators (8 to 32 bit)

The digital blocks can be connected to any GPIO through a

series of global buses that can route any signal to any pin. The

buses also enable signal multiplexing and perform logic opera-

tions. This configurability frees your designs from the constraints

of a fixed peripheral controller.

Row 2

DBB20

DBB30

DCB22

DCB23

Row 3

DBB31

DCB32

DCB33

GIE[7:0]

GIO[7:0]

GOE[7:0]

GOO[7:0]

Global Digital

Interconnect

Document Number: 001-48325 Rev. *E

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