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CY7C404-25LMBR

更新时间： 2024-02-13 11:45:52

品牌	Logo	应用领域
赛普拉斯 - CYPRESS		先进先出芯片
页数	文件大小	规格书
13页	273K
描述
FIFO, 64X5, 37ns, Asynchronous, CMOS, CQCC20, LCC-20

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CY7C404-25LMBR 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
零件包装代码：	DIP	包装说明：	0.300 INCH, DIP-18
针数：	18	Reach Compliance Code：	not_compliant
ECCN代码：	EAR99	HTS代码：	8542.32.00.71
风险等级：	5.79	最长访问时间：	34 ns
其他特性：	BUBBLE BACK 50NS	最大时钟频率 (fCLK)：	25 MHz
周期时间：	40 ns	JESD-30 代码：	R-PDIP-T18
JESD-609代码：	e0	长度：	22.733 mm
内存密度：	320 bit	内存集成电路类型：	OTHER FIFO
内存宽度：	5	功能数量：	1
端子数量：	18	字数：	64 words
字数代码：	64	工作模式：	ASYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	64X5	输出特性：	3-STATE
可输出：	YES	封装主体材料：	PLASTIC/EPOXY
封装代码：	DIP	封装等效代码：	DIP18,.3
封装形状：	RECTANGULAR	封装形式：	IN-LINE
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	NOT SPECIFIED
电源：	5 V	认证状态：	Not Qualified
座面最大高度：	4.826 mm	子类别：	FIFOs
最大压摆率：	0.075 mA	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	技术：	CMOS
温度等级：	COMMERCIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	7.62 mm	Base Number Matches：	1

CY7C404-25LMBR 数据手册

CY7C401/CY7C403

CY7C402/CY7C404

Switching Waveforms

Data In Timing Diagram

I/f

SHIFT IN

DHIR

PHSI

PLSI

INPUT READY

DATA IN

DLIR

HSI

SSI

C401–9

Data Out Timing Diagram

I/f

SHIFT OUT

DHOR

PHSO

PLSO

OUTPUT READY

DATA OUT

DLOR

HSO

SOR

C401–10

Bubble Through, Data Out To Data In Diagram

SHIFT OUT

SHIFT IN

INPUT READY

PIR

DATA IN

HIR

SIR

C401–11

1 2 3 456 7 8...13

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与CY7C404-25LMBR相关器件

型号	品牌	描述	获取价格	数据表
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CY7C404-25PC	CYPRESS	64 x 4 Cascadable FIFO / 64 x 5 Cascadable FIFO	获取价格
CY7C4042KV13	CYPRESS	72-Mbit QDRâ¢-IV XP SRAM	获取价格
CY7C4042KV13-106FCXC	CYPRESS	72-Mbit QDRâ¢-IV XP SRAM	获取价格
CY7C4042KV13-106FCXC	INFINEON	Synchronous SRAM	获取价格
CY7C4042KV13-933FCXC	CYPRESS	72-Mbit QDRâ¢-IV XP SRAM	获取价格