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CY7C1618KV18

更新时间： 2022-02-26 14:10:41

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赛普拉斯 - CYPRESS		双倍数据速率静态存储器
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描述
144-Mbit DDR II SRAM Two-Word Burst Architecture

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CY7C1618KV18 数据手册

CY7C1618KV18/CY7C1620KV18

Logic Block Diagram – CY7C1618KV18

Burst

Logic

Write

Reg

Write

Reg

23 22

(22:0)

Address

(22:1)

Output

R/W

CLK

Logic

Gen.

Control

DOFF

Read Data Reg.

REF

Reg.

Control

Logic

R/W

BWS

[1:0]

[17:0]

Logic Block Diagram – CY7C1620KV18

Burst

Logic

Write

Reg

Write

Reg

22 21

(21:0)

Address

(21:1)

Output

Logic

Control

CLK

R/W

Gen.

DOFF

Read Data Reg.

REF

Reg.

Control

Logic

R/W

BWS

[3:0]

[35:0]

Document Number: 001-44274 Rev. *N

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