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CY7C1386D-250AXC

更新时间： 2024-01-06 13:37:07
品牌 Logo 应用领域
赛普拉斯 - CYPRESS 静态存储器
页数 文件大小 规格书
29页 464K
描述
18-Mbit (512K x 36/1 Mbit x 18) Pipelined DCD Sync SRAM

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CY7C1386D-250AXC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：BGA包装说明：13 X 15 MM, 1.40 MM HEIGHT, MO-216, FBGA-165
针数：165Reach Compliance Code：compliant
ECCN代码：3A991.B.2.AHTS代码：8542.32.00.41
风险等级：5.82最长访问时间：2.6 ns
其他特性：PIPELINED ARCHITECTURE最大时钟频率 (fCLK)：250 MHz
I/O 类型：COMMONJESD-30 代码：R-PBGA-B165
JESD-609代码：e0长度：15 mm
内存密度：18874368 bit内存集成电路类型：CACHE SRAM
内存宽度：36湿度敏感等级：3
功能数量：1端子数量：165
字数：524288 words字数代码：512000
工作模式：SYNCHRONOUS最高工作温度：85 °C
最低工作温度：-40 °C组织：512KX36
输出特性：3-STATE封装主体材料：PLASTIC/EPOXY
封装代码：LBGA封装等效代码：BGA165,11X15,40
封装形状：RECTANGULAR封装形式：GRID ARRAY, LOW PROFILE
并行/串行：PARALLEL峰值回流温度（摄氏度）：220
电源：2.5/3.3,3.3 V认证状态：Not Qualified
座面最大高度：1.4 mm最大待机电流：0.07 A
最小待机电流：3.14 V子类别：SRAMs
最大压摆率：0.35 mA最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：3.135 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：BALL端子节距：1 mm
端子位置：BOTTOM处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：13 mmBase Number Matches：1

CY7C1386D-250AXC 数据手册

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PRELIMINARY  
CY7C1386D  
CY7C1387D  
Pin Definitions (continued)  
Name  
I/O  
Description  
Power supply for the I/O circuitry.  
VDDQ  
I/O Power Supply  
MODE  
TDO  
TDI  
Input-  
Static  
Selects Burst Order. When tied to GND selects linear burst sequence. When tied  
to VDD or left floating selects interleaved burst sequence. This is a strap pin and  
should remain static during device operation. Mode Pin has an internal pull-up.  
JTAG serial output  
Synchronous  
Serial data-out to the JTAG circuit. Delivers data on the negative edge of TCK. If  
the JTAG feature is not being utilized, this pin should be disconnected. This pin is  
not available on TQFP packages.  
JTAG serial  
input  
Serial data-in to the JTAG circuit. Sampled on the rising edge of TCK. If the JTAG  
feature is not being utilized, this pin can be disconnected or connected to VDD. This  
pin is not available on TQFP packages.  
Synchronous  
TMS  
JTAG serial  
input  
Serial data-in to the JTAG circuit. Sampled on the rising edge of TCK. If the JTAG  
feature is not being utilized, this pin can be disconnected or connected to VDD. This  
pin is not available on TQFP packages.  
Synchronous  
TCK  
NC  
JTAG-  
Clock  
Clock input to the JTAG circuitry. If the JTAG feature is not being utilized, this pin  
must be connected to VSS. This pin is not available on TQFP packages.  
–
No Connects. Not internally connected to the die  
Document #: 38-05545 Rev. *A  
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