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CXL5520M/P

更新时间： 2024-01-15 09:26:35
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9页 117K
描述
CMOS-CCD Baseband 1H Delay Line

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CXL5520M/P 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP16,.3
针数：16Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.92
Is Samacsys：N商用集成电路类型：CONSUMER CIRCUIT
JESD-30 代码：R-PDIP-T16JESD-609代码：e0
长度：19.2 mm功能数量：1
端子数量：16最高工作温度：60 °C
最低工作温度：-10 °C封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
认证状态：Not Qualified座面最大高度：4.1 mm
子类别：Other Consumer ICs最大压摆率：25 mA
最大供电电压 (Vsup)：5.25 V最小供电电压 (Vsup)：4.75 V
表面贴装：NO技术：CMOS
温度等级：COMMERCIAL端子面层：Tin/Lead (Sn/Pb)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7.62 mmBase Number Matches：1

CXL5520M/P 数据手册

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CXL5520M/P  
CMOS-CCD Baseband 1H Delay Line  
For the availability of this product, please contact the sales office.  
Description  
CXL5520M  
CXL5520P  
CXL5520 is a CMOS-CCD baseband 1H delay line  
designed for TV signal processing.  
16 pin SOP (Plastic)  
16 pin DIP (Plastic)  
Features  
• Single 5V power supply  
• Low power consumption  
• Built-in line locked PLL circuit  
• Built-in 2 comb filters  
(Addition of delayed and non-delayed output signal.)  
• Built-in peripheral circuits  
Input Signal Amplitude  
• ± (R-Y) PAL and NTSC Vsig 525 mVp-p (Typ.)  
• ± (B-Y) PAL and NTSC Vsig 665 mVp-p (Typ.)  
Absolute Maximum Ratings (Ta = 25°C)  
• ± (R-Y) SECAM  
• ± (B-Y) SECAM  
Vsig 1.05 Vp-p (Typ.)  
Vsig 1.33 Vp-p (Typ.)  
• Supply voltage  
• Operating temperature Topr  
• Storage temperature Tstg  
VDD  
+6  
V
–10 to +60  
°C  
–55 to +150 °C  
Function  
• Allowable power dissipation  
• 2 comb filters outputs  
PD  
(Addition of delayed and non-delayed output signal.)  
• Timing generator and clock driver  
• Line Locked PLL circuit (Sandcastle pulse)  
• Autobias circuit  
CXL5520M 400  
mW  
CXL5520P  
800 mW  
Recommended Operating Condition (Ta = 25°C)  
Supply voltage 5V ± 5%  
• Pulse clamp circuit  
VDD  
• Sample and hold circuit and output Amp.  
Recommended Clock Condition (Ta = 25°C)  
Structure  
• Top pulse voltage  
• Frequency  
VCLK  
fCLK  
3 to 7  
V
CMOS-CCD  
15.625  
kHz  
• Input clock waveform  
Sandcastle pulse  
Pin Description  
Pin  
Pin  
No.  
Symbol  
No.  
Description  
Symbol  
(NC)  
Description  
not connected  
1
2
3
4
5
6
7
8
VDD  
+5V supply voltage  
Autobias output  
not connected  
not connected  
Sandcastle pulse input  
VCO input  
9
AB  
10  
11  
12  
13  
14  
15  
16  
(NC)  
not connected  
(NC)  
(NC)  
SAND  
VCO IN  
(NC)  
GND  
Vo (R-Y)  
Vo (B-Y)  
(NC)  
± (R-Y) output signal  
± (B-Y) output signal  
not connected  
Vi (B-Y)  
(NC)  
± (B-Y) input signal  
not connected  
not connected  
Ground  
Vi (R-Y)  
± (R-Y) input signal  
Sony reserves the right to change products and specifications without prior notice. This information does not convey any license by  
any implication or otherwise under any patents or other right. Application circuits shown, if any, are typical examples illustrating the  
operation of the devices. Sony cannot assume responsibility for any problems arising out of the use of these circuits.  
– 1 –  
E95X04-PS  
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