CXD3003R

更新时间： 2024-01-06 01:00:54

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索尼 - SONY		商用集成电路数字信号处理器
页数	文件大小	规格书
137页	1348K
描述
CD Digital Signal Processor with Built-in Digital Servo and DAC

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CXD3003R 技术参数

生命周期：	Obsolete	零件包装代码：	QFP
包装说明：	LFQFP,	针数：	144
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.83	Is Samacsys：	N
商用集成电路类型：	CONSUMER CIRCUIT	JESD-30 代码：	S-PQFP-G144
长度：	20 mm	功能数量：	1
端子数量：	144	最高工作温度：	75 °C
最低工作温度：	-20 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	LFQFP	封装形状：	SQUARE
封装形式：	FLATPACK, LOW PROFILE, FINE PITCH	认证状态：	Not Qualified
座面最大高度：	1.7 mm	最大供电电压 (Vsup)：	4 V
最小供电电压 (Vsup)：	3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL EXTENDED
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	QUAD	宽度：	20 mm
Base Number Matches：	1

CXD3003R 数据手册

CXD3003R

No.

Symbol

I/O

Description

Channel 2 DAC PWM output (forward phase).

Analog power supply.

AO2F

AV^DD4

AVDD5

XTLO

XTLI

1, Z, 0

Master clock power supply.

Master clock crystal oscillation circuit output.

Master clock crystal oscillation circuit input.

Master clock GND.

1, 0

AVSS5

AVSS3

AO1F

AO1R

AVDD3

AVDD4

SENS

DIRC

SCLK

ATSK

DATA

XLAT

CLOK

DVSS4

COUT

MIRR

DFCT

FOK

Analog GND.

Channel 1 DAC PWM output (forward phase).

Channel 1 DAC PWM output (reversed phase).

Analog power supply.

1, Z, 0

Digital power supply.

SENS output to CPU.

1, Z, 0

Used during 1-track jumps.

SENS serial data readout clock input.

Anti-shock pin.

Serial data input from CPU.

Latch input from CPU. Serial data is latched at the falling edge.

Serial data transfer clock input from CPU.

Digital GND.

100

101

102

103

104

105

106

111

112

Track count signal I/O.

I/O

1, 0

Mirror signal I/O.

Defect signal I/O.

Focus OK signal I/O.

Test pin. Leave this open.

TESTA

PWMI

Spindle motor external pin input.

Spindle motor output filter switching output.

GRSCOR output when $8 command SCOR SEL = high.

113

FSW

1, Z, 0

114

115

116

Spindle motor on/off control output.

Spindle motor servo control output.

MON

MDP

MDS

1, 0

1, Z, 0

GFS is sampled at 460Hz; when GFS is high, this pin outputs a high signal.

If GFS is low eight consecutive samples, this pin outputs low. Input when

LKIN = high.

117

LOCK

I/O

1, 0

118

119

120

121

122

Disc innermost track detection signal input.

Digital GND.

SSTP

DVSS5

SFDR

SRDR

TFDR

Sled drive output.

1, 0

Sled drive output.

Tracking drive output.

– 7 –

1...4 5 678 9 10...137

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