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CD74HC75MT PDF预览

CD74HC75MT

更新时间： 2024-11-24 05:09:07
品牌 Logo 应用领域
德州仪器 - TI 锁存器
页数 文件大小 规格书
19页 430K
描述
Dual 2-Bit Bistable Transparent Latch

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CD74HC75MT 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：SOIC
包装说明：SOP, SOP16,.25针数：16
Reach Compliance Code：compliantHTS代码：8542.39.00.01
Factory Lead Time：1 week风险等级：1.23
系列：HCJESD-30 代码：R-PDSO-G16
JESD-609代码：e4长度：9.9 mm
负载电容（CL）：50 pF逻辑集成电路类型：D LATCH
最大I（ol）：0.0052 A湿度敏感等级：1
位数：2功能数量：2
端子数量：16最高工作温度：125 °C
最低工作温度：-55 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP16,.25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE包装方法：TR
峰值回流温度（摄氏度）：260电源：2/6 V
最大电源电流（ICC）：0.04 mAProp。Delay @ Nom-Sup：24 ns
传播延迟（tpd）：195 ns认证状态：Not Qualified
施密特触发器：No座面最大高度：1.75 mm
子类别：FF/Latches最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：4.5 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：HIGH LEVEL宽度：3.9 mm

CD74HC75MT 数据手册

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CD54HC75, CD74HC75,  
CD54HCT75, CD74HCT75  
Data sheet acquired from Harris Semiconductor  
SCHS135F  
Dual 2-Bit Bistable  
Transparent Latch  
March 1998 - Revised October 2003  
Features  
Description  
• True and Complementary Outputs  
• Buffered Inputs and Outputs  
The ’HC75 and ’HCT75 are dual 2-bit bistable transparent  
latches. Each one of the 2-bit latches is controlled by  
separate Enable inputs (1E and 2E) which are active LOW.  
When the Enable input is HIGH data enters the latch and  
appears at the Q output. When the Enable input (1E and 2E)  
is LOW the output is not affected.  
[ /Title  
(CD74  
HC75,  
CD74  
HCT75  
)
/Sub-  
ject  
(Dual  
2-Bit  
Bistabl  
e
• Fanout (Over Temperature Range)  
- Standard Outputs. . . . . . . . . . . . . . . 10 LSTTL Loads  
- Bus Driver Outputs . . . . . . . . . . . . . 15 LSTTL Loads  
o
o
Ordering Information  
• Wide Operating Temperature Range . . . -55 C to 125 C  
• Balanced Propagation Delay and Transition Times  
TEMP. RANGE  
o
PART NUMBER  
CD54HC75F3A  
CD54HCT75F3A  
CD74HC75E  
( C)  
PACKAGE  
16 Ld CERDIP  
16 Ld CERDIP  
16 Ld PDIP  
• Significant Power Reduction Compared to LSTTL  
Logic ICs  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
• HC Types  
- 2V to 6V Operation  
- High Noise Immunity: N = 30%, N = 30% of V  
IL IH CC  
CD74HC75M  
16 Ld SOIC  
16 Ld SOIC  
16 Ld SOIC  
16 Ld SOP  
at V  
= 5V  
CC  
CD74HC75MT  
CD74HC75M96  
CD74HC75NSR  
CD74HC75PW  
CD74HC75PWR  
CD74HCT75E  
CD74HCT75M  
CD74HCT75PWT  
• HCT Types  
- 4.5V to 5.5V Operation  
- Direct LSTTL Input Logic Compatibility,  
V = 0.8V (Max), V = 2V (Min)  
IL IH  
16 Ld TSSOP  
16 Ld TSSOP  
16 Ld PDIP  
- CMOS Input Compatibility, I ≤ 1µA at V , V  
OL OH  
l
16 Ld SOIC  
16 Ld TSSOP  
NOTE: When ordering, use the entire part number. The suffixes 96  
and R denote tape and reel. The suffix T denotes a small-quantity  
reel of 250.  
Pinout  
CD54HC75, CD54HCT75 (CERDIP)  
CD74HC75 (PDIP, SOIC, SOP, TSSOP)  
CD74HCT75 (PDIP, SOIC, TSSOP)  
TOP VIEW  
1Q0  
1D0  
1D1  
2E  
1
2
3
4
5
6
7
8
16 1Q0  
15 1Q1  
14 1Q1  
13 1E  
V
12 GND  
11 2Q0  
10 2Q0  
CC  
2D0  
2D1  
2Q1  
9
2Q1  
CAUTION: These devices are sensitive to electrostatic discharge. Users should follow proper IC Handling Procedures.  
Copyright © 2003, Texas Instruments Incorporated  
1
1234567...19

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CD74HC75MT 替代型号

型号 品牌 替代类型 描述 数据表
CD74HC75M96 TI

完全替代

 Dual 2-Bit Bistable Transparent Latch
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完全替代

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