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CD74HC107EE4 PDF预览

CD74HC107EE4

更新时间： 2024-02-20 18:39:59
品牌 Logo 应用领域
德州仪器 - TI 触发器
页数 文件大小 规格书
15页 452K
描述
Dual J-K Flip-Flop with Reset Negative-Edge Trigger

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CD74HC107EE4 技术参数

是否Rohs认证： 符合生命周期：Active
零件包装代码：DIP包装说明：DIP, DIP14,.3
针数：14Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.35
系列：HC/UHJESD-30 代码：R-PDIP-T14
JESD-609代码：e4长度：19.3 mm
负载电容（CL）：50 pF逻辑集成电路类型：J-K FLIP-FLOP
最大频率@ Nom-Sup：20000000 Hz最大I（ol）：0.006 A
位数：2功能数量：2
端子数量：14最高工作温度：125 °C
最低工作温度：-55 °C输出极性：COMPLEMENTARY
封装主体材料：PLASTIC/EPOXY封装代码：DIP
封装等效代码：DIP14,.3封装形状：RECTANGULAR
封装形式：IN-LINE包装方法：TUBE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：2/6 V
最大电源电流（ICC）：0.04 mAProp。Delay @ Nom-Sup：51 ns
传播延迟（tpd）：255 ns认证状态：Not Qualified
施密特触发器：No座面最大高度：5.08 mm
子类别：FF/Latches最大供电电压 (Vsup)：6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：4.5 V
表面贴装：NO技术：CMOS
温度等级：MILITARY端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：THROUGH-HOLE端子节距：2.54 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
触发器类型：NEGATIVE EDGE宽度：6.35 mm
最小 fmax：23 MHzBase Number Matches：1

CD74HC107EE4 数据手册

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CD54HC107, CD74HC107,  
CD74HCT107  
Data sheet acquired from Harris Semiconductor  
SCHS139D  
Dual J-K Flip-Flop with Reset  
Negative-Edge Trigger  
March 1998 - Revised October 2003  
Features  
Description  
• Hysteresis on Clock Inputs for Improved Noise Immu-  
nity and Increased Input Rise and Fall Times  
The ’HC107 and CD74HCT107 utilize silicon gate CMOS  
technology to achieve operating speeds equivalent to LSTTL  
parts. They exhibit the low power consumption of standard  
CMOS integrated circuits, together with the ability to drive 10  
LSTTL loads.  
[ /Title  
(CD74  
HC107  
,
CD74  
HCT10  
7)  
/Sub-  
ject  
(Dual  
J-K  
Flip-  
Flop  
with  
Reset  
Nega-  
tive-  
• Asynchronous Reset  
• Complementary Outputs  
• Buffered Inputs  
These flip-flops have independent J, K, Reset and Clock  
inputs and Q and Q outputs. They change state on the  
negative-going transition of the clock pulse. Reset is  
accomplished asynchronously by a low level input.  
• Typical f  
MAX  
= 60MHz at V = 5V, C = 15pF,  
CC L  
o
T = 25 C  
A
• Fanout (Over Temperature Range)  
This device is functionally identical to the HC/HCT73 but  
differs in terminal assignment and in some parametric limits.  
- Standard Outputs. . . . . . . . . . . . . . . 10 LSTTL Loads  
- Bus Driver Outputs . . . . . . . . . . . . . 15 LSTTL Loads  
The HCT logic family is functionally as well as pin compatible  
o
o
• Wide Operating Temperature Range . . . -55 C to 125 C with the standard LS family.  
• Balanced Propagation Delay and Transition Times  
Ordering Information  
• Significant Power Reduction Compared to LSTTL  
Logic ICs  
TEMP. RANGE  
o
PART NUMBER  
CD54HC107F3A  
CD74HC107E  
( C)  
PACKAGE  
14 Ld CERDIP  
14 Ld PDIP  
14 Ld SOIC  
14 Ld SOIC  
14 Ld SOIC  
14 Ld PDIP  
• HC Types  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
-55 to 125  
- 2V to 6V Operation  
- High Noise Immunity: N = 30%, N = 30% of V  
IL IH CC  
CD74HC107M  
at V  
= 5V  
CC  
CD74HC107MT  
CD74HC107M96  
CD74HCT107E  
• HCT Types  
- 4.5V to 5.5V Operation  
- Direct LSTTL Input Logic Compatibility,  
V = 0.8V (Max), V = 2V (Min)  
IL IH  
NOTE: When ordering, use the entire part number. The suffix 96  
denotes tape and reel. The suffix T denotes a small-quantity reel of  
250.  
- CMOS Input Compatibility, I ≤ 1µA at V , V  
OL OH  
l
Pinout  
CD54HC107 (CERDIP)  
CD74HC107 (PDIP, SOIC)  
CD74HCT107 (PDIP)  
TOP VIEW  
1J  
1Q  
1
2
3
4
5
6
7
14 V  
CC  
13 1R  
12 1CP  
11 2K  
10 2R  
1Q  
1K  
2Q  
2Q  
9
8
2CP  
2J  
GND  
CAUTION: These devices are sensitive to electrostatic discharge. Users should follow proper IC Handling Procedures.  
Copyright © 2003, Texas Instruments Incorporated  
1
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CD74HC107EE4 替代型号

型号 品牌 替代类型 描述 数据表
CD74HC107E TI

完全替代

 Dual J-K Flip-Flop with Reset Negative-Edge Trigger

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型号 品牌 获取价格 描述 数据表
CD74HC107EN ETC

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 		IC,FLIP-FLOP,DUAL,J/K TYPE,HC-CMOS,DIP,14PIN,PLASTIC
CD74HC107EX ROCHESTER

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