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BQ7791506PWR

更新时间： 2025-07-24 11:11:03
品牌 Logo 应用领域
德州仪器 - TI 电池光电二极管
页数 文件大小 规格书
56页 1859K
描述
具有电池自主平衡功能的 3 节至 5 节串联可堆叠超低功耗初级保护器 | PW | 24 | -40 to 85

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BQ7791506PWR 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active包装说明：TSSOP, TSSOP24,.25,25
Reach Compliance Code：compliantFactory Lead Time：6 weeks
风险等级：5.68可调阈值：YES
模拟集成电路 - 其他类型：POWER SUPPLY SUPPORT CIRCUITJESD-30 代码：R-PDSO-G24
JESD-609代码：e4长度：7.8 mm
湿度敏感等级：2信道数量：1
功能数量：1端子数量：24
最高工作温度：85 °C最低工作温度：-40 °C
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装等效代码：TSSOP24,.25,25封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH座面最大高度：1.2 mm
最大供电电流 (Isup)：0.08 mA最大供电电压 (Vsup)：25 V
最小供电电压 (Vsup)：3 V标称供电电压 (Vsup)：20 V
表面贴装：YES温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
宽度：4.4 mmBase Number Matches：1

BQ7791506PWR 数据手册

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BQ77915  
www.ti.com.cn  
ZHCSHU6K – MARCH 2018 – REVISED JULY 2023  
7 Pin Configuration and Functions  
VDD  
AVDD  
VC5  
VC4  
VC3  
VC2  
VC1  
VC0  
VSS  
SRP  
SRN  
DSG  
1
24  
23  
22  
21  
20  
19  
18  
17  
16  
15  
14  
13  
CTRD  
CTRC  
PRES  
CBO  
CCFG  
VTB  
2
3
4
5
6
7
TS  
8
OCDP  
CBI  
9
10  
11  
12  
LPWR  
LD  
CHG  
Not to scale  
图 7-1. PW Package 24-Pin TSSOP Top View  
表 7-1. Pin Functions  
NUMBER  
NAME  
VDD  
I/O  
DESCRIPTION  
1
2
P(1)  
Supply voltage  
AVDD  
VC5  
VC4  
VC3  
VC2  
VC1  
VC0  
VSS  
SRP  
SRN  
DSG  
CHG  
LD  
O
I
Analog supply (only connect to a capacitor)  
3
4
I
5
I
Cell voltage sense inputs  
6
I
7
I
8
I
9
P
I
Analog ground  
10  
11  
12  
13  
14  
Current sense input connecting to the battery side of the sense resistor  
Current sense input connecting to the pack side of the sense resistor  
DSG FET driver output  
I
O
O
I
CHG FET driver output  
PACK– load removal detection  
HIBERNATE mode communication pin. Connect to the PRES pin of the lower device in a stack  
configuration. For a single device, leave the LPWR pin floating.  
15  
16  
LPWR  
CBI  
O
I
Cell balancing input. Leave the CBI pin floating to disable cell balancing, and do not drive  
with an external supply. Drive the pin low to enable cell balancing. In a stacked configuration,  
connect the CBI pin of an upper device to the CBO pin of the immediate lower device.  
Connecting a resistor from this pin to VSS programs the OCD1/2 fault detection delay. Connect  
to a 10-MΩ resistor to VSS for the upper devices in a stack.  
17  
18  
OCDP  
TS  
I
I
Thermistor measurement input. Connect a 10-kΩ resistor to the VSS pin if the function is not  
used.  
19  
20  
VTB  
O
I
Thermistor bias output  
CCFG  
Cell in-series configuration input  
Cell balancing output. Connect through a 10-k resistor to the CBI pin of the upper device in a  
stacked configuration. For a single device, leave the CBO pin floating.  
21  
22  
CBO  
O
I
HIBERNATE mode input. Drive high for NORMAL mode operation. Leave the PRES pin  
floating for HIBERNATE mode. Connect to the LPWR pin of the upper device in a stack  
configuration.  
PRES  
Copyright © 2023 Texas Instruments Incorporated  
4
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Product Folder Links: BQ77915  
English Data Sheet: SLUSCU0  
 
1234567...56

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型号 品牌 获取价格 描述 数据表
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