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Datasheet > 存储 > SRAM> AS7C31024-15TC
AS7C31024-15TC PDF预览

AS7C31024-15TC

更新时间： 2024-01-08 10:50:28
品牌 Logo 应用领域
ALSC 静态存储器
页数 文件大小 规格书
9页 199K
描述
5V/3.3V 128K x 8 CMOS SRAM (Evolutionary Pinout)

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AS7C31024-15TC 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：DIP包装说明：DIP, DIP32,.3
针数：32Reach Compliance Code：unknown
ECCN代码：3A991.B.2.BHTS代码：8542.32.00.41
风险等级：5.72最长访问时间：15 ns
I/O 类型：COMMONJESD-30 代码：R-PDIP-T32
JESD-609代码：e0内存密度：1048576 bit
内存集成电路类型：STANDARD SRAM内存宽度：8
功能数量：1端口数量：1
端子数量：32字数：131072 words
字数代码：128000工作模式：ASYNCHRONOUS
最高工作温度：70 °C最低工作温度：
组织：128KX8输出特性：3-STATE
可输出：YES封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP32,.3
封装形状：RECTANGULAR封装形式：IN-LINE
并行/串行：PARALLEL峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3 V认证状态：Not Qualified
最大待机电流：0.0005 A最小待机电流：2 V
子类别：SRAMs最大压摆率：0.07 mA
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：3 V
标称供电电压 (Vsup)：3.3 V表面贴装：NO
技术：CMOS温度等级：COMMERCIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIEDBase Number Matches：1

AS7C31024-15TC 数据手册

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AS7C1024  
AS7C31024  
®
Read cycle (over the operating range)  
-10  
-12  
-15  
-20  
Parameter  
Read cycle time  
Symbol Min Max Min Max Min Max Min Max Unit  
Notes  
tRC  
tAA  
10  
–
–
–
–
2
3
3
–
–
0
–
0
–
–
10  
10  
10  
3
12  
–
–
–
–
3
3
3
–
–
0
–
0
–
–
12  
12  
12  
3
15  
–
–
–
–
3
3
3
–
–
0
–
0
–
–
15  
15  
15  
4
20  
–
–
–
–
3
3
3
–
–
0
–
0
–
–
20  
20  
20  
5
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
Address access time  
3
Chip enable (CE1) access time  
Chip enable (CE2) access time  
Output enable (OE) access time  
Output hold from address change  
CE1 Low to output in low Z  
CE2 High to output in low Z  
CE1 Low to output in high Z  
CE2 Low to output in high Z  
OE Low to output in low Z  
OE High to output in high Z  
Power up time  
tACE1  
tACE2  
tOE  
3, 12  
3, 12  
tOH  
–
–
–
–
5
tCLZ1  
tCLZ2  
tCHZ1  
tCHZ2  
tOLZ  
tOHZ  
tPU  
–
–
–
–
4, 5, 12  
4, 5, 12  
4, 5, 12  
4, 5, 12  
4, 5  
–
–
–
–
3
3
4
5
3
3
4
5
–
–
–
–
3
3
4
5
4, 5  
–
–
–
–
4, 5, 12  
4, 5, 12  
Power down time  
tPD  
10  
12  
15  
20  
Key to switching waveforms  
Rising input  
Falling input  
Undefined / don’t care  
Read waveform 1 (address controlled)  
t
RC  
Address  
t
t
AA  
OH  
D
Data valid  
OUT  
Read waveform 2 (CE1, CE2, and OE controlled)  
t
RC1  
CE1  
CE2  
OE  
t
OE  
t
t
OHZ  
OLZ  
t
, t  
CHZ1 CHZ2  
t
,
ACE1 tACE2  
D
OUT  
Data valid  
t
, t  
CLZ1 CLZ2  
t
PD  
I
CC  
t
PU  
Current  
supply  
I
50%  
50%  
SB  
4
ALLIANCE SEMICONDUCTOR  
11/ 29/ 00  
1234567...9

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