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AMIS30532C5321G

更新时间： 2024-02-20 05:10:54
品牌 Logo 应用领域
安森美 - ONSEMI 驱动器电机
页数 文件大小 规格书
29页 439K
描述
Micro-Stepping Motor Driver

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AMIS30532C5321G 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：End Of Life零件包装代码：QFN
包装说明：HVQCCN,针数：32
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：25 weeks 5 days
风险等级：5.73模拟集成电路 - 其他类型：STEPPER MOTOR CONTROLLER
JESD-30 代码：S-XQCC-N32JESD-609代码：e3
长度：7 mm功能数量：1
端子数量：32最高工作温度：125 °C
最低工作温度：-40 °C最大输出电流：1.6 A
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：NOT SPECIFIED座面最大高度：0.9 mm
最大供电电压 (Vsup)：30 V最小供电电压 (Vsup)：6 V
标称供电电压 (Vsup)：12 V表面贴装：YES
温度等级：AUTOMOTIVE端子面层：Matte Tin (Sn)
端子形式：NO LEAD端子节距：0.65 mm
端子位置：QUAD处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：7 mmBase Number Matches：1

AMIS30532C5321G 数据手册

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AMIS−30532  
Registers are updated with  
the internal status at the  
rising edge of CS  
The NEW DATA is written into the  
correspondinginternal register at  
the rising edge of CS  
CS  
DI  
COMMAND  
DATA  
COMMAND  
READ DATA  
from ADDR2  
WRITE DATA  
to ADDR2  
NEW DATA  
forADDR2  
COMMAND  
or DUMMY  
DATA from previous  
command or NOT VALID  
after POR or RESET  
DATA  
DATA  
DATA  
DATA  
NEW DATA  
from ADDR2  
OLD DATA  
or NOT VALID  
OLD DATA  
fromADDR2  
OLD DATA  
from ADDR2  
DO  
Figure 23. A WRITE Operation Where DATA from the Master is Written in SPI Register with Address 2 Followed by  
a READ Back Operation to Confirm a Correct WRITE Operation  
NOTE: The internal data−out shift buffer of AMIS−30532 is updated with the content of the selected SPI register only at the last (every  
eight) falling edge of the CLK signal (see SPI Transfer Format and Pin Signals). As a result, new data for transmission cannot be  
written to the shift buffer at the beginning of the transfer packet and the first byte shifted out might represent old data.  
Table 13. SPI CONTROL REGISTERS (All SPI control registers have Read/Write Access and default to “0” after power−on or  
hard reset)  
Structure  
Bit 7  
R/W  
0
Bit 6  
R/W  
0
Bit 5  
R/W  
0
Bit 4  
R/W  
0
Bit 3  
R/W  
0
Bit 2  
R/W  
0
Bit 1  
R/W  
0
Bit 0  
R/W  
0
Content  
Access  
Reset  
Data  
Address  
WR (00h)  
CR0 (01h)  
CR1 (02h)  
CR2 (03h)  
CR2 (08h)  
WDEN  
WDT[3:0]  
−
−
−
Data  
SM[2:0]  
NXTP  
SLP  
CUR[4:0]  
PWMJ  
−
Data  
DIRCTRL  
MOTEN  
−
−
PWMF  
EMC[1:0]  
Data  
SLAG  
SLAT  
−
−
−
−
Data  
M[1:0]  
StrB[1:0]  
StrC  
StrE[1:0]  
Where:  
R/W  
Reset:  
Read and Write access  
Status after power-On or hard reset  
http://onsemi.com  
24  
1...21222324252627...29

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