AFE1105EA

更新时间： 2024-02-20 06:14:07

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10页	208K
描述
Digital SLIC, 1-Func, CMOS, PDSO48,

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AFE1105EA 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
Reach Compliance Code：	unknown	风险等级：	5.81
数据速率：	512 Mbps	JESD-30 代码：	R-PDSO-G48
JESD-609代码：	e0	功能数量：	1
端子数量：	48	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	SSOP	封装等效代码：	SSOP48,.4
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE
峰值回流温度（摄氏度）：	NOT SPECIFIED	电源：	3.3/5,5 V
认证状态：	Not Qualified	子类别：	Other Telecom ICs
标称供电电压：	3.3 V	表面贴装：	YES
技术：	CMOS	电信集成电路类型：	DIGITAL SLIC
温度等级：	INDUSTRIAL	端子面层：	Tin/Lead (Sn/Pb)
端子形式：	GULL WING	端子节距：	0.635 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
Base Number Matches：	1

AFE1105EA 数据手册

0.1µF

PLL_OUT

PLL_IN

REF_P

V_CM

REF_N

1kΩ

1:2.3 Transformer

Tip

14.7Ω

txLINE_P

txLINE_N

0.01µF

200Ω

196Ω

14.7Ω

Ring

0.1µF

Neg

Pos

MtH1210B

XMTDA

0.01µF

Compromise

Hybrid

txDAT

Neg

Pos

XMTLE

RCVCK

txCLK

rxSYNC

750Ω

0.1µF

2kΩ

rxHYB_P

rxHYB_N

RCVG0

rxGAIN1

AFE1105

100pF

750Ω

REF_N

2kΩ

0.1µF

RCVD11 - RCVD0

rxD13 - rxD2

rxGAIN0

DV_DD

Input anti-alias

filter f_C1MHz

0.1µF

rxLOOP

PGND

DGND

AGND

rxLINE_N

rxLINE_P

2kΩ

750Ω

REF_N

2kΩ

100pF

0.1µF

750Ω

DV_DD

PV_DD

AV_DDAV_DDAV_DD

5V to 3.3V Digital

0.1µF

5V Analog

1 - 10µF

0.1µF 0.1µF 0.1µF

10µF

0.1µF

4, 14, 15 NC

0.1µF and 2.2µF

caps on ±5V supplies

5 - 10Ω resistor for isolation

LOG COM

ANA COM

VCXCK

VCXLE

VCXDA

0.1µF

I_OUT

PCM56

CLK

18.2kΩ

12.1kΩ

DATA

V_OUT

VCXCN

69.8kΩ

30.1kΩ

MC33201D

0.1µF

2.2µF

FIGURE 2. Basic Connection Diagram.

rxHYBAND rxLINE INPUT ANTI-ALIASING FILTERS

rxHYB AND rxLINE INPUT BIAS VOLTAGE

The –3dB frequency of the input anti-aliasing filter for the

rxLINE and rxHYB differential inputs should be about

1MHz. Suggested values for the filter are 750Ω for each of

the two input resistors and 100pF for the capacitor. Together

the two 750Ω resistors and the 100pF capacitor result in

–3dB frequency of just over 1MHz. The 750Ω input resis-

tors will result in a minimal voltage divider loss with the

input impedance of the AFE1105.

The transmitter output on the txLINE pins is centered at

midscale, 2.5V. But, the rxLINE input signal is centered at

1.5V in the circuit shown in Figure 2 above.

Inside the AFE1105, the rxHYB and rxLINE signals are

subtracted as described in the paragraph on echo cancella-

tion above. This means that the rxHYB inputs need to be

centered at 1.5V just as the rxLINE signal is centered at

1.5V. REF_N(Pin 36) is a 1.5V voltage source. The external

compromise hybrid must be designed so that the signal into

the rxHYB inputs is centered at 1.5V.

This circuit applies at both T1 and E1 rates. For slower rates,

the antialiasing filters will give best performance with their

–3dB frequency approximately equal to the bit rate. For

example, a –3dB frequency of 500kHz should be used for a

single pair bit rate of 500kbps.

AFE1105

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AFE1115E	BB	HDSL/MDSL ANALOG FRONT END WITH VCXO	获取价格
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AFE1115E/1K	BB	Digital SLIC, 1-Func, PDSO56, PLASTIC, SSOP-56	获取价格
AFE1115E-1/1K	BB	Digital SLIC, 1-Func, PDSO56, PLASTIC, SSOP-56	获取价格
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