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ADUC7126BSTZ126

更新时间： 2024-02-20 23:15:21
品牌 Logo 应用领域
亚德诺 - ADI 时钟微控制器外围集成电路
页数 文件大小 规格书
110页 1497K
描述
Precision Analog Microcontroller, 12-Bit Analog I/O, Large Memory, ARM7TDMI MCU with Enhanced IRQ Handler

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ADUC7126BSTZ126 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：QFP
包装说明：ROHS COMPLIANT, MO-026BDD, LQFP-80针数：80
Reach Compliance Code：compliantECCN代码：3A991.A.2
HTS代码：8542.31.00.01风险等级：5.31
具有ADC：YES地址总线宽度：
位大小：32CPU系列：ARM7
最大时钟频率：41.78 MHzDAC 通道：YES
DMA 通道：NO外部数据总线宽度：
JESD-30 代码：S-PQFP-G80JESD-609代码：e3
长度：12 mm湿度敏感等级：1
I/O 线路数量：40端子数量：80
最高工作温度：125 °C最低工作温度：-40 °C
PWM 通道：YES封装主体材料：PLASTIC/EPOXY
封装代码：LFQFP封装等效代码：QFP80,.55SQ,20
封装形状：SQUARE封装形式：FLATPACK, LOW PROFILE, FINE PITCH
峰值回流温度（摄氏度）：260电源：3/3.3 V
认证状态：Not QualifiedRAM（字节）：32768
ROM（单词）：129024ROM可编程性：FLASH
座面最大高度：1.6 mm速度：41.78 MHz
子类别：Microcontrollers最大供电电压：3.6 V
最小供电电压：2.7 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Matte Tin (Sn)
端子形式：GULL WING端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：30
宽度：12 mmuPs/uCs/外围集成电路类型：MICROCONTROLLER, RISC
Base Number Matches：1

ADUC7126BSTZ126 数据手册

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ADuC7124/ADuC7126  
Data Sheet  
tBUF  
tR  
SDA (I/O)  
MSB  
LSB  
ACK  
MSB  
tF  
tDSU  
tDSU  
tDHD  
tDHD  
tPSU  
tR  
tSHD  
tRSU  
tH  
1
2–7  
8
9
1
SCL (I)  
tL  
P
S
S(R)  
tF  
STOP  
START  
REPEATED  
START  
CONDITION CONDITION  
Figure 2. I2C-Compatible Interface Timing  
SPI Timing  
Table 4. SPI Master Mode Timing (Phase Mode = 1)  
Parameter  
Description  
Min  
Typ  
Max  
Unit  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
tSL  
tSH  
SCLK low pulse width1  
SCLK high pulse width1  
Data output valid after SCLK edge  
Data input setup time before SCLK edge1  
Data input hold time after SCLK edge1  
Data output fall time  
(SPIDIV + 1) × tUCLK  
(SPIDIV + 1) × tUCLK  
tDAV  
tDSU  
tDHD  
tDF  
tDR  
tSR  
25  
1 × tUCLK  
2 × tUCLK  
5
5
5
5
12.5  
12.5  
12.5  
12.5  
Data output rise time  
SCLK rise time  
SCLK fall time  
tSF  
ns  
1 tUCLK = 23.9 ns. It corresponds to the 41.78 MHz internal clock from the PLL before the clock divider.  
SCLK  
(POLARITY = 0)  
tSH  
tSL  
tSR  
tSF  
SCLK  
(POLARITY = 1)  
tDAV  
tDF  
tDR  
MOSI  
MISO  
MSB  
BIT 6 TO BIT 1  
LSB  
MSB IN  
BIT 6 TO BIT 1  
LSB IN  
tDSU  
tDHD  
Figure 3. SPI Master Mode Timing (Phase Mode = 1)  
Rev. D | Page 10 of 110  
1...78910111213...110

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