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ADP3421

更新时间： 2024-01-30 09:12:22
品牌 Logo 应用领域
亚德诺 - ADI 转换器DC-DC转换器控制器
页数 文件大小 规格书
12页 149K
描述
Geyserville-Enabled DC-DC Converter Controller for Mobile CPUs

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ADP3421 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SSOP包装说明：TSSOP,
针数：28Reach Compliance Code：not_compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.22模拟集成电路 - 其他类型：SWITCHING CONTROLLER
最大输入电压：5 V最小输入电压：3 V
标称输入电压：3.3 VJESD-30 代码：R-PDSO-G28
JESD-609代码：e0长度：9.7 mm
湿度敏感等级：3功能数量：1
端子数量：28最高工作温度：100 °C
最低工作温度：封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：240
认证状态：Not Qualified座面最大高度：1.2 mm
表面贴装：YES切换器配置：SINGLE
温度等级：OTHER端子面层：Tin/Lead (Sn85Pb15)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
宽度：4.4 mmBase Number Matches：1

ADP3421 数据手册

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ADP3421  
Parameter  
Symbol  
Conditions  
Min  
Typ  
Max  
Unit  
CURRENT LIMIT COMPARATOR  
Input Offset Voltage  
Input Bias Current  
VCLOS  
ICL+  
ICL–  
VCS– = 1.3 V  
VCS+ = 1.3 V  
VCORE = VRAMP = 1.3 V  
–6  
–5  
+6  
+5  
mV  
µA  
Hysteresis Current  
VREG = 1.28 V, VCS– = 1.3 V  
V
V
CS+ = 1.28 V  
IHYS Open  
RIHYS = 170 kΩ  
R
–5  
–38  
–335  
µA  
µA  
µA  
–22  
–265  
–30  
–300  
RIHYS = 17 kΩ  
CS+ = 1.32 V  
RIHYS Open  
–5  
µA  
µA  
µA  
V
ns  
ns  
R
R
IHYS = 170 kΩ  
IHYS = 17 kΩ  
–13  
–175  
1.53  
–20  
–200  
1.70  
30  
–27  
–225  
1.87  
60  
Hysteresis Setting Reference Voltage VVHYS  
7
Propagation Delay Time6  
tCLPD  
TA = 25°C  
0°C ≤ TA ≤ 100°C  
50  
100  
LINEAR REGULATOR SOFT-START TIMER  
Charge Current  
ISSC(UP)  
VSSC = 0 V  
VSSC = 1.7 V, VUVLO = 1.1 V  
–0.6  
0.3  
–1.0  
1.0  
150  
1.70  
–1.4  
µA  
mA  
mV  
V
Discharge Current  
Enable Threshold  
Termination Threshold  
ISSC(DN)  
4
VSSCEN  
400  
1.87  
VSSCTH  
1.53  
2.5 V CLK LDO CONTROLLER  
Feedback Bias Current  
Output Drive Current  
ICLKFB  
ICLKDRV  
VCLKFB = 2.5 V  
VCLKDRV = 2.55 V  
12.5  
25  
1
20  
µA  
µA  
V
CLKDRV = 2.45 V  
3
mA  
mA/V  
DC Transconductance  
GCLK  
∆ICLKDRV = 1 mA  
500  
7.5  
1.5 V I/O LDO CONTROLLER  
Feedback Bias Current  
Output Drive Current  
IIOFB  
IIODRV  
VIOFB = 1.5 V  
VIODRV = 1.53 V  
15  
1
60  
µA  
µA  
mA  
mA/V  
V
IODRV = 1.47 V  
10  
DC Transconductance  
GIO  
∆ICLKDRV = 1 mA  
650  
LEVEL TRANSLATOR  
Input Clamping Threshold  
Output Voltage  
VLTIH  
VLTOH  
VLTOL  
tLTPD  
ILTI = –10 µA  
ILTI = –10 µA9  
VLTI = 0.175 V9  
0.95  
0.9 × VCCLT  
1.5  
VCCLT  
375  
V
V
mV  
ns  
Propagation Delay Time6  
10  
NOTES  
1VCORE ramps up monotonically.  
2VCORE ramps down monotonically.  
3During latency time of VID code change, the Power Good output signal should not be considered valid.  
4Internal bias and soft start are not enabled unless the soft-start pin voltage first drops below the enable threshold.  
5Measured from 50% of VID code transient amplitude to the point where VDAC settles within 1% of its steady state value.  
6Guaranteed by characterization.  
740 mV p-p amplitude impulse with 20 mV overdrive. Measure from the input threshold intercept point to 50% of the output voltage swing.  
8Measured between the 30% and 70% points of the output voltage swing.  
9The LTO output tied to VCCLT = 2.5 V rail through an RLTO = 150 Ω pull-up resistor.  
Specifications subject to change without notice.  
REV. A  
–3–  
1234567...12

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