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AD9882AKSTZ-140

更新时间： 2024-02-22 07:45:13
品牌 Logo 应用领域
亚德诺 - ADI 显示器
页数 文件大小 规格书
40页 1484K
描述
Dual Interface for Flat Panel Displays

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AD9882AKSTZ-140 技术参数

是否无铅： 含铅是否Rohs认证： 符合
生命周期：Obsolete零件包装代码：QFP
包装说明：LEAD FREE, PLASTIC, MS-026BED, LQFP-100针数：100
Reach Compliance Code：unknownECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.02
其他特性：IT ALSO REQUIRES 2.2V TO 3.6V FOR OUTPUT商用集成电路类型：CONSUMER CIRCUIT
JESD-30 代码：S-PQFP-G100JESD-609代码：e3
长度：14 mm湿度敏感等级：3
功能数量：1端子数量：100
最高工作温度：70 °C最低工作温度：
封装主体材料：PLASTIC/EPOXY封装代码：LFQFP
封装等效代码：QFP100,.63SQ,20封装形状：SQUARE
封装形式：FLATPACK, LOW PROFILE, FINE PITCH峰值回流温度（摄氏度）：260
电源：3.3 V认证状态：Not Qualified
座面最大高度：1.6 mm子类别：Other Consumer ICs
最大压摆率：420 mA最大供电电压 (Vsup)：3.45 V
最小供电电压 (Vsup)：3.15 V表面贴装：YES
技术：CMOS温度等级：COMMERCIAL
端子面层：Matte Tin (Sn)端子形式：GULL WING
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：14 mm
Base Number Matches：1

AD9882AKSTZ-140 数据手册

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AD9882A  
AD9882AKSTZ  
Temp Test Level Min Typ Max Unit  
Parameter  
Conditions  
POWER SUPPLY  
VD Supply Voltage  
VDD Supply Voltage  
PVD Supply Voltage  
ID Supply Current (Typical Pattern)1  
IDD Supply Current (Typical Pattern)1, 2  
IPVD Supply Current (Typical Pattern) 1  
Full  
Full  
Full  
25°C  
25°C  
25°C  
Full  
IV  
IV  
IV  
V
V
V
3.15 3.3  
2.2 3.3  
3.15 3.3  
3.45  
3.45  
3.45  
V
V
V
mA  
mA  
mA  
mA  
237  
25  
57  
Total Supply Current with HDCP  
IV  
340 367  
(Typical Pattern) 1, 2  
ID Supply Current (Worst-Case Pattern)3  
25°C  
25°C  
V
V
247  
61  
mA  
mA  
IDD Supply Current  
(Worst-Case Pattern) 2, 3  
IPVD Supply Current  
(Worst-Case Pattern) 3  
Total Supply Current with HDCP  
(Worst-Case Pattern) 2, 3  
25°C  
Full  
Full  
V
57  
mA  
mA  
mA  
IV  
VI  
385 420  
Power-Down Supply Current (IPD)  
AC SPECIFICATIONS  
30  
35  
Intrapair (+ to –) Differential Input  
Full  
Full  
Full  
IV  
IV  
IV  
360  
1
ps  
Skew (TDPS  
Channel-to-Channel Differential  
Input Skew (TCCS  
Low-to-High Transition Time  
for Data (DLHT  
)
Clock Period  
ns  
)
Output drive = high, CL = 10 pF  
2.2  
)
Output drive = medium,  
CL = 7 pF  
Output drive = low, CL = 5 pF  
Output drive = high, CL = 10 pF  
Full  
Full  
Full  
IV  
IV  
IV  
2.5  
3.2  
1.0  
ns  
ns  
ns  
Low-to-High Transition Time  
for DATACK (DLHT  
)
Output drive = medium,  
CL = 7 pF  
Output drive = low, CL = 5 pF  
Output drive = high, CL = 10 pF  
Full  
Full  
Full  
IV  
IV  
IV  
1.6  
2.1  
2.2  
ns  
ns  
ns  
High-to-Low Transition Time  
for Data (DHLT  
)
Output drive = medium,  
CL = 7 pF  
Output drive = low, CL = 5 pF  
Output drive = high,  
CL = 10 pF  
Full  
Full  
Full  
IV  
IV  
IV  
1.9  
1.7  
1.0  
ns  
ns  
ns  
High-to-Low Transition Time  
for DATACK (DHLT  
)
Output drive = medium,  
CL = 7 pF  
Output drive = low, CL = 5 pF  
Full  
Full  
Full  
Full  
Full  
IV  
IV  
IV  
IV  
VI  
1.0  
1.4  
+2.0 ns  
50  
112  
ns  
ns  
Clock -to- Data Skew,4 tSKEW  
–0.5  
40  
25  
4
Duty Cycle, DATACK  
46  
%
MHz  
DATACK Frequency (FCIP)  
1 The typical pattern contains a gray scale area. Output drive = high.  
2 DATACK load = 10 pF, data load = 10 pF.  
3 The worst-case pattern contains a black and white checkerboard pattern. Output drive = high.  
4 Drive strength = 11.  
Rev. 0 | Page 5 of 40  
 
 
 
 
 
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