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Datasheet > 微控制器和处理器 > 时钟发生器> AD9572ACPZLVD-R7
AD9572ACPZLVD-R7 PDF预览

AD9572ACPZLVD-R7

更新时间： 2024-02-12 09:57:29
品牌 Logo 应用领域
亚德诺 - ADI 晶体时钟发生器光纤微控制器和处理器外围集成电路PC以太网
页数 文件大小 规格书
20页 410K
描述
Fiber Channel/Ethernet Clock Generator IC, PLL Core, Dividers, 7 Clock Outputs

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AD9572ACPZLVD-R7 技术参数

是否无铅：含铅是否Rohs认证：符合
生命周期：Active零件包装代码：QFN
包装说明：HVQCCN, LCC40,.24SQ,20针数：40
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.24
Samacsys Confidence：Samacsys Status：Released
Schematic Symbol：https://componentsearchengine.com/symbol.php?partID=578874PCB Footprint：https://componentsearchengine.com/footprint.php?partID=578874
Samacsys PartID：578874Samacsys Image：https://componentsearchengine.com/Images/9/AD9572ACPZLVD-R7.jpg
Samacsys Thumbnail Image：https://componentsearchengine.com/Thumbnails/1/AD9572ACPZLVD-R7.jpgSamacsys Pin Count：41
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Other
Samacsys Footprint Name：QFN50P600X600X80-41NSamacsys Released Date：2017-01-11 11:21:59
Is Samacsys：NJESD-30 代码：S-XQCC-N40
JESD-609代码：e3长度：6 mm
端子数量：40最高工作温度：85 °C
最低工作温度：-40 °C最大输出时钟频率：156.25 MHz
封装主体材料：UNSPECIFIED封装代码：HVQCCN
封装等效代码：LCC40,.24SQ,20封装形状：SQUARE
封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE峰值回流温度（摄氏度）：260
电源：3.3 V主时钟/晶体标称频率：25 MHz
认证状态：Not Qualified座面最大高度：0.8 mm
子类别：Clock Generators最大供电电压：3.6 V
最小供电电压：3 V标称供电电压：3.3 V
表面贴装：YES技术：CMOS
温度等级：INDUSTRIAL端子面层：MATTE TIN
端子形式：NO LEAD端子节距：0.5 mm
端子位置：QUAD处于峰值回流温度下的最长时间：40
宽度：6 mmuPs/uCs/外围集成电路类型：CLOCK GENERATOR, OTHER
Base Number Matches：1

AD9572ACPZLVD-R7 数据手册

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AD9572  
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS  
PIN 1  
GND  
VS  
NC  
25M  
VS  
1
2
3
4
5
6
7
8
9
30 106M  
29 106M  
28 VS  
27 FREQSEL  
26 VS  
25 VS  
24 VS  
23 33M  
22 100M/125M  
21 100M/125M  
INDICATOR  
AD9572  
TOP VIEW  
XO  
XO  
REFCLK  
REFSEL  
(Not to Scale)  
GND 10  
NOTES  
1. * = SHORT TO PIN 36.  
2. ** = SHORT TO PIN 14.  
3. NC = NO CONNECT.  
4. NOTE THAT THE EXPOSED PADDLE ON THIS PACKAGE IS AN ELECTRICAL  
CONNECTION AS WELL AS A THERMAL ENHANCEMENT. FOR THE DEVICE TO  
FUNCTION PROPERLY, THE PADDLE MUST BE ATTACHED TO GROUND (GND).  
Figure 6. Pin Configuration  
Table 13. Pin Function Descriptions1  
Pin No.  
Mnemonic  
Description  
3
NC  
No Connect. This pin should be left floating.  
2
4
VS  
25M  
Power Supply Connection for the 25M CMOS Buffer.  
CMOS 25 MHz Output.  
5
6, 7  
8
9
11  
VS  
XO  
REFCLK  
REFSEL  
Power Supply Connection for the Crystal Oscillator.  
External 25 MHz Crystal.  
25 MHz Reference Clock Input. Tie low when not in use.  
Logic Input. Used to select the reference source.  
Power Supply Connection for the GbE PLL.  
VS  
1, 10, 34  
14, 36  
15  
GND  
BYPASS2, BYPASS1  
VS  
Ground. Includes external paddle (EPAD).  
These pins are for bypassing each LDO to ground with a 220 nF capacitor.  
Power Supply Connection for the GbE VCO.  
16  
17  
18  
VS  
Power Supply Connection for the 156M LVDS Output Buffer and Output Dividers.  
LVPECL/LVDS Output at 156.25 MHz.  
Complementary LVPECL/LVDS Output at 156.25 MHz.  
LVPECL/LVDS Output at 100 MHz or 125 MHz. Selected by FREQSEL pin strapping.  
Complementary LVPECL/LVDS Output at 100 MHz or 125 MHz.  
CMOS 33.33 MHz Output.  
156M  
156M  
100M/125M  
100M/125M  
33M  
19, 21  
20, 22  
23  
24  
25  
26  
27  
28  
29, 31  
30, 32  
VS  
VS  
VS  
FREQSEL  
VS  
Power Supply Connection for the 33M CMOS Output Buffer and Output Dividers.  
Power Supply Connection for the 100M/125M LVDS Output Buffer and Output Dividers.  
Power Supply Connection for the GbE PLL Feedback Divider.  
Logic Input. Used to configure output drivers.  
Power Supply Connection for the FC PLL Feedback Divider.  
LVPECL/LVDS Output at 106.25 MHz.  
106M  
106M  
Complementary LVPECL/LVDS Output at 106.25 MHz.  
Rev. 0 | Page 10 of 20  
 
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