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AD7278BRMJ

更新时间： 2024-02-12 01:32:27
品牌 Logo 应用领域
亚德诺 - ADI 转换器模数转换器光电二极管
页数 文件大小 规格书
20页 254K
描述
3MSPS,12-/10-/8-Bit ADCs in 6-Lead TSOT

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AD7278BRMJ 技术参数

是否无铅： 不含铅是否Rohs认证： 符合
生命周期：Active零件包装代码：TSSOP
包装说明：TSSOP,针数：8
Reach Compliance Code：unknown风险等级：5.68
Is Samacsys：N最大模拟输入电压：3.6 V
最小模拟输入电压：最长转换时间：0.291 µs
转换器类型：ADC, SUCCESSIVE APPROXIMATIONJESD-30 代码：S-PDSO-G8
JESD-609代码：e3长度：3 mm
最大线性误差 (EL)：0.3906%湿度敏感等级：1
模拟输入通道数量：1位数：8
功能数量：1端子数量：8
最高工作温度：125 °C最低工作温度：-40 °C
输出位码：BINARY输出格式：SERIAL
封装主体材料：PLASTIC/EPOXY封装代码：TSSOP
封装形状：SQUARE封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：260采样速率：3 MHz
采样并保持/跟踪并保持：TRACK座面最大高度：1.1 mm
标称供电电压：3 V表面贴装：YES
温度等级：AUTOMOTIVE端子面层：MATTE TIN
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：40
宽度：3 mmBase Number Matches：1

AD7278BRMJ 数据手册

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PRELIMINARYTECHNICALDATA  
Preliminary Technical Data  
AD7276/AD7277/AD7278  
t1  
tconvert  
t2  
t6  
B
SCLK  
3
1
2
4
10  
11  
12  
13  
15  
16  
14  
t7  
t8  
t5  
tquiet  
t3  
t4  
DB8  
DB9  
DB1  
Z
ZERO  
DB0  
ZERO  
ZERO  
ZERO  
ZERO  
SDATA  
THREE-  
STATE  
THREE-STATE  
4TRAILING ZERO’S  
2 LE ADI NG  
ZERO’S  
1/ THROUGHPUT  
Figure 17. AD7277 Serial Interface Timing Diagram  
t1  
tconvert  
t2  
t6  
B
SCLK  
1
2
3
4
8
9
10  
15  
11  
14  
16  
t7  
t8  
t5  
tquiet  
t3  
t4  
DB6  
Z
ZERO  
DB7  
DB1  
DB0  
ZERO  
ZERO  
6TRAILING ZERO’S  
ZERO  
SDATA  
THREE-  
STATE  
THREE-STATE  
2 LEADI NG  
ZERO’S  
1/ THROUGHPUT  
Figure 18. AD7278 Serial Interface Timing Diagram  
AD7278 in a 10 SCLK’s cycle Serial Interface  
From Figure 19, tACQ comprises of 0.5(1/fSCLK) + t8  
+
For the AD7278, if CS is brought high in the 10th rising  
edge after the 2 leading zeros and the 8 bits of the  
conversion have been provided, the part can achieve a  
4.2MSPS throughput rate. For the AD7278, the track and  
hold goes back into track in the 9th rising edge. In that  
case, a fSCLK ꢀ 52 MHz and a throughput of 4.2MSPS,  
gives a cycle time of t2 + 8.5(1/fSCLK) + tACQ ꢀ 238ns.  
With t2 ꢀ TBDns min, this leaves tACQ to be TBDns.  
t
QUIET, where t8 ꢀ TBDns max. This allows a value of  
TBDns for tQUIET satisfying the minimum requirement of  
TBDns.  
This TBDns satisfies the requirement of 50 ns for tACQ  
.
t1  
tconvert  
t2  
t6  
B
SCLK  
1
2
3
4
5
9
10  
tQUIET  
tACQ  
t8  
8.5 (1/ fSCLK)  
DB5  
SDATA  
Z
DB7  
DB6  
DB0  
ZERO  
DB1  
3-STATE  
3-STATE  
2 LEADING ZERO’S  
1/ THROUGHPUT  
Figure 19. AD7278 in a 10 SCLK Cycle Serial Interface  
REV. PrF  
–19–  
1...1617181920

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