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AD5372BCPZ-RL7

更新时间： 2024-01-08 18:15:59
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亚德诺 - ADI 转换器
页数 文件大小 规格书
28页 507K
描述
32-Channel, 16-Bit, Serial Input, Voltage-Output DAC

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AD5372BCPZ-RL7 技术参数

Source Url Status Check Date：2013-05-01 14:56:12.511是否无铅： 含铅
是否Rohs认证： 符合生命周期：Obsolete
零件包装代码：QFN包装说明：HVQCCN, LCC64,.35SQ,20
针数：64Reach Compliance Code：compliant
ECCN代码：EAR99HTS代码：8542.39.00.01
风险等级：5.64最大模拟输出电压：15.1 V
最小模拟输出电压：-3.1 V转换器类型：D/A CONVERTER
输入位码：BINARY输入格式：SERIAL
JESD-30 代码：S-XQCC-N64JESD-609代码：e3
长度：9 mm最大线性误差 (EL)：0.0061%
湿度敏感等级：3标称负供电电压：-15 V
位数：16功能数量：1
端子数量：64最高工作温度：85 °C
最低工作温度：-40 °C封装主体材料：UNSPECIFIED
封装代码：HVQCCN封装等效代码：LCC64,.35SQ,20
封装形状：SQUARE封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260电源：3/5,+-10/+-15 V
认证状态：Not Qualified座面最大高度：1 mm
最大稳定时间：30 µs标称安定时间 (tstl)：20 µs
子类别：Other Converters最大压摆率：18 mA
标称供电电压：15 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：MATTE TIN端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：40宽度：9 mm
Base Number Matches：1

AD5372BCPZ-RL7 数据手册

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AD5372/AD5373  
GENERAL DESCRIPTION  
The AD5372/AD5373 have a high speed serial interface that is  
compatible with SPI, QSPI™, MICROWIRE™, and DSP inter-  
face standards and can handle clock speeds of up to 50 MHz.  
The AD5372/AD5373 contain 32 16-/14-bit DACs in 64-lead  
LQFP and LFCSP packages. The devices provide buffered  
voltage outputs with a nominal span of 4× the reference voltage.  
The gain and offset of each DAC can be independently trimmed  
to remove errors. For even greater flexibility, the device is divided  
into four groups of eight DACs. Two offset DACs allow the  
output range of the groups to be altered. Group 0 can be adjusted  
by Offset DAC 0, and Group 1 to Group 3 can be adjusted by  
Offset DAC 1.  
The DAC registers are updated on reception of new data. All  
LDAC  
the outputs can be updated simultaneously by taking the  
input low. Each channel has a programmable gain and an offset  
adjust register.  
Each DAC output is gained and buffered on chip with respect  
to an external SIGGNDx input. The DAC outputs can also be  
The AD5372/AD5373 offer guaranteed operation over a wide  
supply range: VSS from −16.5 V to −4.5 V and VDD from 9 V to  
16.5 V. The output amplifier headroom requirement is 1.4 V  
operating with a load current of 1 mA.  
CLR  
switched to SIGGNDx via the  
pin.  
Table 1. High Channel Count Bipolar DACs  
Model  
Resolution (Bits)  
Nominal Output Span  
4 × VREF (20 V)  
4 × VREF (20 V)  
4 × VREF (20 V)  
4 × VREF (20 V)  
4 × VREF (12 V)  
4 × VREF (12 V)  
4 × VREF (12 V)  
4 × VREF (12 V)  
8.75 V  
Output Channels  
Linearity Error (LSB)  
AD5360  
AD5361  
AD5362  
AD5363  
AD5370  
AD5371  
AD5372  
AD5373  
AD5378  
AD5379  
16  
14  
16  
14  
16  
14  
16  
14  
14  
14  
16  
16  
8
4
1
4
1
4
1
4
1
3
3
8
40  
40  
32  
32  
32  
40  
8.75 V  
Rev. C | Page 3 of 28  
 
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